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大家好，
我在ML605板和ISE 13.2上使用Virtex 6。 我必须使用来自FMC连接器的信号：这是我的自定义IP的时钟。 在映射期间，编译器报告以下错误： “错误：放置：1153 - 已发现时钟IOB / BUFGCTRL时钟组件对未放置在最佳时钟 IOB / BUFGCTRL网站对。 时钟IOB组件放置在现场。 相应的BUFGCTRL组件放置在现场。 如果a）将IOB放置在具有到所有BUFGCTRL站点的最快专用路径的全局时钟能够的IOB站点上，或者b）将IOB放置在本地上，则时钟IO可以使用IOB和时钟缓冲器之间的快速路径。 具有时钟功能的IOB站点，在其设备的一半（TOP或BOTTOM）中具有专用于BUFGCTRL站点的快速路径。 您可能想要分析存在此问题的原因并进行更正。 如果此子设计可接受此子优化条件，则可以使用.ucf文件中的CLOCK_DEDICATED_ROUTE约束将此消息降级为警告并允许您的设计继续。 但是，强烈建议不要使用此覆盖，因为它可能导致非常差的时序结果。 建议在设计中纠正此错误情况。 下面列出了此时钟放置规则中使用的所有COMP.PIN的列表。 这些示例可以直接在.ucf文件中使用，以覆盖此时钟规则。 “ 所以我试着在.ucf文件中添加这个约束，但结果完全一样。 你能解释一下为什么以及究竟发生了什么？ 谢谢 西罗 
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5个回答
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嗨，
这种情况几乎没有可能发生，请参考以下链接 http://www.xilinx.com/support/answers/34346.htm 希望这可以帮助。 问候， Vanitha。 -------------------------------------------------- -------------------------------------------请在发布前进行谷歌搜索， 您可能会找到相关信息。请留下帖子 - “接受为解决方案”，如果提供的信息有用且回复，请给予赞誉 在原帖中查看解决方案 |
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嗨，
这种情况几乎没有可能发生，请参考以下链接 http://www.xilinx.com/support/answers/34346.htm 希望这可以帮助。 问候， Vanitha。 -------------------------------------------------- -------------------------------------------请在发布前进行谷歌搜索， 您可能会找到相关信息。请留下帖子 - “接受为解决方案”，如果提供的信息有用且回复，请给予赞誉 |
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要做的第一件事是检查翻译消息，看看是否由于某种原因你的约束被忽略了。
顺便说一句，错误消息将约束括在尖括号中，但那些不应该进入UCF文件。 约束应如下所示： NET“sensor_video_1_iClock_pin”CLOCK_DEDICATED_ROUTE = FALSE; - Gabor |
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感谢你的及时回复。
我显然省略了brakets，并尝试在“OR”中给出了所需LOC的约束： NET sensor_video_1_iClock_pin LOC =“AD30”| CLOCK_DEDICATED_ROUTE = FALSE; 结果不会改变。 |
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Vanitha的小费很成功;
通过使用以下环境变量“XIL_PAR_OVERRIDE_CLKPH1_RULES”将错误降级为警告来使用非最佳放置，引脚被接受。 我设置环境变量运行 SET XIL_PAR_OVERRIDE_CLKPH1_RULES = 1 在Windows命令提示符下 非常感谢 西罗 |
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只有小组成员才能发言，加入小组>>
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