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Vivado 2016.2错误核心访问失败的原因？

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问答对人有帮助，内容完整，我也想知道答案 0 你好我有一个设计合成和实现没有任何计时错误。但是当我在转储比特流后触发ILA时，出现了这个错误 - 错误：[Xicom 50-38] xicom：核心访问失败。检查电缆连接并确定目标板已通电，然后使用disconnect_hw_server和connect_hw_server重新初始化硬件目标。使用open_hw_target重新注册硬件设备。错误：[Xicom 50-38] xicom：核心访问失败。检查电缆连接并确定目标板已通电，然后使用disconnect_hw_server和connect_hw_server重新初始化硬件目标。使用open_hw_target重新注册硬件设备。错误：[Xicom 50-38] xicom：核心访问失败。检查电缆连接并确定目标板已通电，然后使用disconnect_hw_server和connect_hw_server重新初始化硬件目标。使用open_hw_target重新注册硬件设备。错误：[Xicom 50-38] xicom：核心访问失败。检查电缆连接并确定目标板已通电，然后使用disconnect_hw_server和connect_hw_server重新初始化硬件目标。使用open_hw_target重新注册硬件设备。错误：[Xicom 50-38] xicom：核心访问失败。检查电缆连接并确定目标板已通电，然后使用disconnect_hw_server和connect_hw_server重新初始化硬件目标。使用open_hw_target重新注册硬件设备。错误：[Labtools 27-3176] hw_server在内部命令期间失败。解决方案：检查hw_server是否正在运行以及与目标的硬件连接我有一张FMC卡作为设计的一部分。事情尝试 - 1.更改FMC端口 2.减少ILA的探针数量 3.使设计更小 4.检查JTAG的IR长度这些都没有成功。我尝试了很多设计的变化，在一些设计中，我在触发ILA后立即得到错误，而在其他设计中，它在4-5触发后出现。我一直在努力解决这个问题，现在，请建议一下可能是错的。 0
2020-6-4 16:32:05　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × asd008 该类别下有 32 个回答。邀请回答 aaaa321 该类别下有 27 个回答。邀请回答 doublelove 该类别下有 26 个回答。邀请回答 vynywrwr 该类别下有 21 个回答。邀请回答 hgjhgd 该类别下有 19 个回答。邀请回答 bwerwer 该类别下有 18 个回答。邀请回答 hanyan533 该类别下有 18 个回答。邀请回答 Jaionm 该类别下有 18 个回答。邀请回答 handsomelchcpp 该类别下有 17 个回答。邀请回答 wang2222222 该类别下有 17 个回答。邀请回答 ningee 该类别下有 16 个回答。邀请回答 binro 该类别下有 16 个回答。邀请回答 myf888 该类别下有 15 个回答。邀请回答 wznnzw 该类别下有 15 个回答。邀请回答 yhxc 该类别下有 14 个回答。邀请回答 armortech 该类别下有 14 个回答。邀请回答 60user25 该类别下有 14 个回答。邀请回答 zcy615 该类别下有 14 个回答。邀请回答 wanglinhua2627 该类别下有 14 个回答。邀请回答 guotong1984 该类别下有 14 个回答。邀请回答举报贾永世相关推荐 • Vivado 2016.2合成失败的原因是什么？如何解决? 3507 • vivado2016.2怎么下载？如何破解？ 1843 • Vivado 2016.2实施错误 18769 • Vivado 2016.2在2015.3没有的时机失败 1617 • 运行时错误Vivado 2016.2 2255 • 可以使用凭证生成许可并使用vivado 2016.2加载吗 651 • Vivado 2016.2无法在Debian中进行综合是为什么？ 1389 • 安装Vivado 2016.2 webpack License Aggreement问题 2004 • Vivado引擎内存不足怎么办 7174 • vivado zynq实现错误 7643 3个回答

答案对人有帮助，有参考价值 0 Y，你检查过电源轨吗？可能是您的设计吸收了如此多的电流，电源电压低于建议的工作条件。铁轨有哪些电流供电？目前它们关闭了什么？他们会自动重启吗？系统监视器会告诉您哪些电压来自硬件管理器？最低记录是否低于推荐值？ VC707使用TI PMIC，您可以看到他们使用TI PMBus加密狗电缆连接到PC上的USB端口。 Austin Lesea主要工程师Xilinx San Jose

2020-6-4 16:47:04 评论举报潘晶燕

答案对人有帮助，有参考价值 0 嗨奥斯汀你可以告诉我如何检查从电源轨拉出的电流。如果事实证明这是原因，怎么解决呢？什么是系统监控？请原谅我的基本疑虑，我还是FPGA的新手

2020-6-4 17:01:03 评论举报欧竞仲

答案对人有帮助，有参考价值 0 阅读VC707说明，电路板上的电源允许测量。 https://www.google.com/url?sa=t&rct=j&q=&esrc=s&source=web&cd=4&cad=rja&uact=8&ved=0ahUKEwjn4puLlevVAhXowVQKHQeYD44QFghGMAM&url= HTTPS％3A％2F％2Fwww.xilinx.com％2Fsupport％2Fanswers％2F37561.html＆安培; USG = AFQjCNFdcpUj2UXV_j7zREpPTku_zS5kVg 系统监视器是每7个系列设备内置的AD转换器。也称为XADC。 https://www.xilinx.com/products/technology/analog-mixed-signal.html 至于如何防止这种情况，要么通过降低时钟频率，减少逻辑等来获得更大的电源，要么降低现有电源的负载。问题可能是在相同的时钟边沿上切换太多。然后你可以将你的一些逻辑移动到相移时钟边沿的不同时钟。 Austin Lesea主要工程师Xilinx San Jose

2020-6-4 17:11:18 评论举报潘晶燕

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