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大家好，
我正在尝试建立一个带有几条LVDS线路的项目，这令人沮丧。 我原本期望的功能类似于：http：//www.vhdl.us/SecondEdition_unrestricted/Pedroni_ExtraMaterial_Using_LVDS_pins_v1.pdf 我本来期望宣布一个输入信号 输入：在std_logic中; 然后能够将它链接到一个适当的输入缓冲区，它将把LVDS输入转换为幕后的std_logic给我。 我确信在某个地方有很好的方法或用户指南，但我找不到它。 所以这是我的问题： 我是否需要在端口列表中声明真实和否定信号？ 如果这是肯定的，他们是正确的std_logic？ 我知道_P和_N是常见的后缀，但它们是否必须使工具正确识别对？ 感谢任何帮助！ 提前致谢， dabell 
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9个回答
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必须在代码中将差分输入和输出缓冲区实例化为IBUFDS或OBUFDS。
他们无法推断。 您的顶级端口声明大多数包括连接到IBUFDS I和IB端口的P和N端口或OBUFDS O＆amp; OB端口。 IBUFDS的输出端口和OBUFDS的输入端口将是单个std_logic信号。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com 在原帖中查看解决方案 |
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必须在代码中将差分输入和输出缓冲区实例化为IBUFDS或OBUFDS。
他们无法推断。 您的顶级端口声明大多数包括连接到IBUFDS I和IB端口的P和N端口或OBUFDS O＆amp; OB端口。 IBUFDS的输出端口和OBUFDS的输入端口将是单个std_logic信号。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com |
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太好了，谢谢！我刚刚浏览了xapp485.zip中的top4_rx.vhd文件并注意到了。
（对于将来寻找示例的人）.O和OB端口在这段代码中似乎是std_logic，这是标准吗？非常感谢，dabell |
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> O和OB端口在这段代码中似乎是std_logic，是标准吗？
Xilinx VHDL组件的所有端口都定义为std_logic或std_logic_vector。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com |
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dabell-cc写道：在这段代码中，O和OB端口似乎是std_logic，是标准吗？
缓冲区的端口声明为std_logic，因为这是表示真实数字逻辑情况的最常用类型。 ----------------------------是的，我这样做是为了谋生。 |
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谢谢贝斯曼！
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哦，没有看到。谢谢回答我的问题mcgett！
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@mshEvery引脚应具有IO标准。
如果要将其用作LVDS差分输入引脚，则需要指定LVDS_25。 仅供参考，始终为新查询创建新线程以获得更快的响应和可见性 -------------------------------------------------- -------------------------------------------------- ----------------没有一个愚蠢的问题。 随意问，但快速搜索，以确保它还没有得到解答。 保持对话，获得Kudos和Accept Solution。 -------------------------------------------------- -------------------------------------------------- ------------------- |
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只有小组成员才能发言，加入小组>>
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