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电子发烧友论坛
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嗨亲爱的。
我设计了一个系统，它在选择接口向导中对数据进行反序列化，然后将它们保存在FIFO中。 我使用的Fifo来自IPcore FIFO生成器。 为了正确地在FIFO中写入并行信号，我将wr_clk连接到clk_div_out，如下图所示。 但综合后，有两个警告如下： [Vivado 12-1008]找不到命令'get_clocks -of_objects [get_ports -scoped_to_current_instance wr_clk]'的时钟。 [“/sources_1/bd/design_1/ip/design_1_fifo_generator_0_0/design_1_fifo_generator_0_0/design_1_fifo_generator_0_0_clocks.xdc":53] [Common 17-55]'get_property'需要至少一个对象。 [“/sources_1/bd/design_1/ip/design_1_fifo_generator_0_0/design_1_fifo_generator_0_0/design_1_fifo_generator_0_0_clocks.xdc":61] 警告[共同17-55]是一个严重警告。 我想也许wr_clk不会将selectiO接口向导中的clk_div_out视为时钟端口？ 但是我怎么能解决这个问题呢？ 或者我可以忽略它，因为它实际上不会导致硬件内部出现问题？ 谢谢。 YL 
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6个回答
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你好@ liuyanbc157
您需要在驱动选择IO IP时钟输入引脚的端口上写入约束。 约束应如下所示 create_clock -period 10 [get_ports clk_in] 谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题 张贴。 如果某人的帖子回答了您的问题，请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子，考虑给它Kudos（左边的明星） 在原帖中查看解决方案 |
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你好@ liuyanbc157
您需要在连接到顶级xdc中的select io向导的clk_in引脚的端口上编写create_clock约束。 谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题 张贴。 如果某人的帖子回答了您的问题，请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子，考虑给它Kudos（左边的明星） |
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嗨，
关于为selectio Interface Wizard添加约束，我还有两个问题。 1.我使用的SIW是在一个子系统中。 所以在顶层文件中，我应该将约束写为 create_clock -period 10 [get_ports RX_system_0 / U0 / design_1_i / selectio_wiz_0 / clk_in] set_input_jitter [get_clocks -of_objects [get ports RX_system_0 / U0 / design_1_i / selectio_wiz_0 / clk_in] 0.1 而是来自下面的SelectIO Interface Wizard v5.1 LogiCORE IP产品指南的原始版本？ create_clock -period 10 [get_ports clk_in] set_input_jitter [get_clocks -of_objects [get ports clk_in] 0.1 2. selectIO的时钟是通过对数据进行过采样从某个地方恢复的时钟，而不是来自时钟向导的PLL时钟，这意味着对于100MHz应用，周期时间在10 ns时并不总是稳定，有时可能是11ns。 如果我使用这样的约束creat_clock -period 10，会发生什么？ 谢谢， YL |
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请检查以下答案中的信息是否有助于调试您的问题。
https://www.xilinx.com/support/answers/63960.html https://www.xilinx.com/support/answers/66666.html _______________________________________________如果有助于解决您的查询，请将此帖子标记为“接受为解决方案”。 因此，它将有助于其他论坛用户直接参考答案。如果您认为该信息有用且面向答复，请给予此帖子称赞。 |
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你好@ liuyanbc157
您需要在驱动选择IO IP时钟输入引脚的端口上写入约束。 约束应如下所示 create_clock -period 10 [get_ports clk_in] 谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题 张贴。 如果某人的帖子回答了您的问题，请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子，考虑给它Kudos（左边的明星） |
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