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电子发烧友论坛
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嗨，
引脚为PS UART引脚。 这些不需要在UCF中定义。 fileps7_constraints.ucf通常会为您处理这些端口。 --Hem -------------------------------------------------- --------------------------------------------请注意 - 请注明 如果提供的信息有用，请回答“接受为解决方案”。给予您认为有用并回复导向的帖子。感谢K-- -------------------------------------------------- --------------------- |
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嗨，
该文件位于$ XPS_Project / data文件夹中 --Hem -------------------------------------------------- --------------------------------------------请注意 - 请注明 如果提供的信息有用，请回答“接受为解决方案”。给予您认为有用并回复导向的帖子。感谢K-- -------------------------------------------------- --------------------- |
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您的VHDL设计在Zynq-7000器件的PL（可编程逻辑）部分实现，您尝试分配的UART引脚位于Zynq-7000的PS（处理器系统）部分。
你不能编写VHDL代码来使用PS中的资源只有PL。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com |
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嗨，
那么你想在PL中实现UARTLITE内核并通过EMIO引脚来访问PS UART吗？ --Hem -------------------------------------------------- --------------------------------------------请注意 - 请注明 如果提供的信息有用，请回答“接受为解决方案”。给予您认为有用并回复导向的帖子。感谢K-- -------------------------------------------------- --------------------- |
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