[问答]

请问哪个设备应该在OSERDES2中传输CLK0信号，信号CLK1和IOCE？

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问答对人有帮助，内容完整，我也想知道答案 0 你好。我想创建一个小费XC6SLX16-3FT256 + AD9739 + DDR3。尊敬的xapp1064，下载http://www.xilinx.com/support/do ... tes/xapp1064.zipBut编辑后尝试编译两个14位DDR串行器4：1（四个14位总线，每个250 MHz，到创建流28 Gbit / sec）Xilinx ise给出错误ERROR：Place - ConstraintResolved DAC00 / inst_clkgen / bufio2_inst1ERROR没有可放置的站点：Place - ConstraintResolvedDAC00 / inst_clkgen / bufio2_inst2ERROR没有可放置的站点：Place - ConstraintResolvedDAC01 / inst_clkgen / bufio2_inst1ERROR没有可放置的站点： Place - ConstraintResolvedDAC01 / inst_clkgen / bufio2_inst2ERROR没有可放置的站点：放置 - SIO过度约束组件DAC00 / inst_clkgen / bufio2_inst1必须放置可放置的站点。约束来自驱动程序约束和loadIO约束我阅读文档并了解bufio2只有一半的库。结果，我不明白哪个设备应该在OSERDES2中传输CLK0信号，信号CLK1和IOCE？在我的情况下两年前，我连接了virtex 6和AD9739，没有任何问题。 GEN_USB_V3_.zip 1692 KB 0
2019-8-5 10:16:54　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × asd008 该类别下有 32 个回答。邀请回答 aaaa321 该类别下有 27 个回答。邀请回答 doublelove 该类别下有 26 个回答。邀请回答 vynywrwr 该类别下有 21 个回答。邀请回答 hgjhgd 该类别下有 19 个回答。邀请回答 bwerwer 该类别下有 18 个回答。邀请回答 hanyan533 该类别下有 18 个回答。邀请回答 Jaionm 该类别下有 18 个回答。邀请回答 handsomelchcpp 该类别下有 17 个回答。邀请回答 wang2222222 该类别下有 17 个回答。邀请回答 ningee 该类别下有 16 个回答。邀请回答 binro 该类别下有 16 个回答。邀请回答 wznnzw 该类别下有 15 个回答。邀请回答 myf888 该类别下有 15 个回答。邀请回答 guotong1984 该类别下有 14 个回答。邀请回答 yhxc 该类别下有 14 个回答。邀请回答 armortech 该类别下有 14 个回答。邀请回答 60user25 该类别下有 14 个回答。邀请回答 zcy615 该类别下有 14 个回答。邀请回答 wanglinhua2627 该类别下有 14 个回答。邀请回答举报郭静相关推荐 • OSERDES2间歇性地工作 3469 • DCM不同的时钟信号会改变clk0的频率 2843 • Spartan 6 OSERDES2模块最大速率不对该怎么办？ 2807 • DCM_SP输出CLK0是否与其CLKIN输入同步？ 2982 • 需要使用两片AD9765同步输出4个电流，两片AD9765的WRT和CLK信号可共用吗？ 287 • 怎么在不重新配置FPGA的情况下切换到OSERDES2输出 1393 • 请教时序约束中offset问题 3652 • 怎么在代码中实现DCM 1947 • 请问ML505的Diff_Clk_Out_P_SMA可以作为单个clk输出工作吗？ 1072 • DDR IODELAY2中的引脚连接失败 3114 1个回答

答案对人有帮助，有参考价值 0 PLL补偿设置不正确也可能导致不正确的反序列化。在你的情况下，这是一个嫌疑人。如果是这种情况，那么以下信息可能有助于调试在serdes_1_to_n_clk_pll_s8_diff.vhd文件的VHDL源代码中，PLL补偿线被注释掉。补偿模式应设置为SOURCE_SYNCHRONOUS。因此，用户应该取消注释该行，以便它将读取 COMPENSATION =>“SOURCE_SYNCHRONOUS”，另一个嫌疑人是关于ISERDES的速度。请注意，在Spartan-6中，ISERDES的最高速度限制为2：1和3：1 DDR。这些性能数据基于特征数据。由于I / O可以以超过1Gbps的速度运行，因此I / O不受限制。但是，在结构中以超过1Gbps的速度运行2：1设计将要求您以500MHz运行，这可能很难满足时序要求。如果您需要SERDES的完整数据速率，请确保使用更高的反序列化比率。 _______________________________________________如果有助于解决您的查询，请将此帖子标记为“接受为解决方案”。因此，它将有助于其他论坛用户直接参考答案。如果您认为该信息有用且面向答复，请给予此帖子称赞。

2019-8-5 10:32:17 评论举报张颖