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【verilog每日一练】Testbench的仿真时间单位和仿真精度
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【verilog每日一练】Testbench的时钟信号的产生
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2023-9-7
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基于紫光同创FPGA的图像采集及AI加速|2023集创赛紫光同创杯优秀作品
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2023-9-22
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【紫光同创PGL50H】小眼睛科技盘古50K开发板试用体验之测测DDR3
辛一
2023-9-21
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多通道高性能视频采集与加速系统|2023集创赛紫光同创杯优秀作品
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2023-9-21
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小眼睛FPGA
2023-9-21
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【盖楼抢好礼】欢迎小眼睛科技有限公司入驻FPGA开发者技术社区!
小伍
2023-6-14
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【紫光同创PGL50H】小眼睛科技盘古50K开发板试用体验之开箱点亮LED
辛一
2023-9-12
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【verilog每日一练】“inout” 双向端口类型的使用
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2023-8-3
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2023-8-2
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【每日一练】参与FPGA技术社区每日学习，轻松掌握Verilog语法！
小伍
2023-8-1
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2023-9-8
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2023-8-8
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【verilog每日一练】位拼接符的应用：如何实现串行数据的接收与输出
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2023-8-7
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工商网监