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测试AIC3254的环出遇到的疑问求解答

问答对人有帮助，内容完整，我也想知道答案 0 我现在正在测试AIC3254的环出：模拟信号进行A/D转换生成数字信号后，经过了一个均衡器，再进行D/A转化为模拟信号经过HeadPhone输出。调了几天了，都不通，不知道哪里有问题。 ================================================================================================================== 我的硬件是将AIC3254与DM8168的McASP[0]想连接。3254的MCLK由外部晶振提供，频率为24.576KHz。设置采样率为44.1KHz。计算时钟见下图。 ==================================================================================================== 我在PPS里的编程如下： ==================================================================================================== 我将生成的代码通过PPS写入评估板，评估板能正常工作。然后我把生成的寄存器数组（修改电源，时钟，接口，通道后）通过自己的程序写入3254芯片，却没有输出。下面是我修改后的寄存器代码(自己修改的寄存器后都有注释/////////////)： static const t_i2c_reg i2c_aic3254[] = {/{{{/ { 0,0x00}, // # reg[ 0][ 1] = 0x01 ; Initialize the device through software reset { 1,0x01}, {254,0x0A}, { 0,0x01}, // # reg[ 1][ 1] = 0x08 ; Power up AVDD LDO; Disable weak AVDD to DVDD connection; Enable Master Analog Power Control, AVDD LDO Powered; Disable weak AVDD to DVDD connection { 1,0x08}, // # reg[ 1][ 2] = 0x00 ; Enable Master Analog Power Control { 2,0xF0},//////////////// // # reg[ 1][ 71] = 0x32 ; Set the input power-up time to 3.1ms { 71,0x32}, // # reg[ 1][123] = 0x01 ; Set REF charging time to 40ms (automatic) {123,0x01}, {255,0x00}, {255,0x01}, { 0,0x00}, // # reg[ 0][ 60] = 0x00 ; DAC prog Mode: miniDSP_A and miniDSP_D NOT powered up together, miniDSP_A used for signal processing { 60,0x00}, // # reg[ 0][ 61] = 0x00 ; Use miniDSP_A for signal processing { 61,0x00}, // # reg[ 0][ 17] = 0x08 ; 8x Interpolation { 17,0x08}, // # reg[ 0][ 23] = 0x04 ; 4x Decimation { 23,0x04}, // { 15,0x03}, // { 16,0x88}, // { 21,0x03}, // { 22,0x88}, { 0,0x08}, // # reg[ 8][ 1] = 0x04 ; adaptive mode for ADC { 1,0x04}, { 0,0x2C}, // # reg[ 44][ 1] = 0x04 ; adaptive mode for DAC { 1,0x04}, { 0,0x00}, // # reg[ 0][ 5] = 0x91 ; P=1, R=1, J=8 { 5,0xA1},///////// # PLL is powered up;P=2;R=1 // # reg[ 0][ 6] = 0x08 ; P=1, R=1, J=8 { 6,0x07},///////// J=7 // # reg[ 0][ 7] = 0x00 ; D=0000 (MSB) { 7,0x0D},///////// D=3500(MSB) // # reg[ 0][ 8] = 0x00 ; D=0000 (LSB) { 8,0xAC},///////// D=3500(LSB) // # reg[ 0][ 4] = 0x03 ; PLL_clkin = MCLK, codec_clkin = PLL_CLK, PLL on { 4,0x43},/////////// // # reg[ 0][ 12] = 0x88 ; MDAC = 8, divider powered on { 12,0x82},/////////M=2 // # reg[ 0][ 13] = 0x00 ; DOSR = 128 (MSB) { 13,0x00}, // # reg[ 0][ 14] = 0x80 ; DOSR = 128 (LSB) { 14,0x80}, // # reg[ 0][ 18] = 0x02 ; NADC = 2, divider powered off { 18,0x08},/////////N=8 // # reg[ 0][ 19] = 0x88 ; MADC = 8, divider powered on { 19,0x82},/////////M=2 // # reg[ 0][ 20] = 0x80 ; AOSR = 128 { 20,0x80}, // # reg[ 0][ 11] = 0x82 ; NDAC = 2, divider powered on { 11,0x88},/////////N=8 ///////////////////////////////////// Audio Interface Settings {0x1b,0x0c},//////// # I2S;16bit;BCLK output;WCLK output {0x1c,0x00},//////// # Data Offset = 0BCLK {0x1d,0x03},//////// {0x1e,0x82},//////// {0x20,0x00},//////// {0x21,0x18},//////// { 0,0x01}, // # reg[ 1][ 51] = 0x40 ; Mic Bias enabled, Source = Avdd, 1.25V { 51,0x40}, // # reg[ 1][ 52] = 0x40 ; Route IN2L to LEFT_P with 10K input impedance; Route CM1L to LEFT_M with 10K input impedance; Route IN2R to RIGHT_P with 10K input impedance; Route IN1L to LEFT_P with 10K input impedance { 52,0x55},///////// # Route IN1_L IN2_L IN3_L IN1_R to Input LEFT_P // # reg[ 1][ 54] = 0x40 ; Route CM1L to LEFT_M with 10K input impedance { 54,0x40}, // # reg[ 1][ 55] = 0x40 ; Route IN1R to RIGHT_P with 10K input impedance { 55,0x55},//////// # Route IN1_R IN2_R IN2_R IN2_L to Output RIGHT_P // # reg[ 1][ 57] = 0x40 ; Route CM1R to RIGHT_M with 10K input impedance { 57,0x40}, // # reg[ 1][ 59] = 0x00 ; Enable MicPGA_L Gain Control, 0dB { 59,0x00}, // # reg[ 1][ 60] = 0x00 ; Enable MicPGA_R Gain Control, 0dB { 60,0x00}, { 0,0x00}, // # reg[ 0][ 81] = 0xc0 ; Power up LADC/RADC { 81,0xC0}, // # reg[ 0][ 82] = 0x00 ; Unmute LADC/RADC { 82,0x00}, {0x53,0x14},///////// # ADC_L Gain 10dB {0x54,0x14},///////// # ADC_L Gain 10dB { 0,0x01}, // # reg[ 1][ 20] = 0x25 ; De-pop: 5 time constants, 6k resistance { 20,0x25}, // # reg[ 1][ 12] = 0x08 ; Route LDAC to HPL { 12,0x0a},///////// // # reg[ 1][ 13] = 0x08 ; Route RDAC to HPR { 13,0x0a},///////// // # reg[ 1][ 14] = 0x08 ; Route LDAC to LOL { 14,0x08}, // # reg[ 1][ 15] = 0x08 ; Route LDAC to LOR { 15,0x08}, { 0,0x00}, // # reg[ 0][ 63] = 0xd4 ; Power up LDAC/RDAC w/ soft stepping { 63,0xD4}, { 0,0x01}, // # reg[ 1][ 16] = 0x00 ; Unmute HPL driver, 0dB Gain { 16,0x00}, // # reg[ 1][ 17] = 0x00 ; Unmute HPR driver, 0dB Gain { 17,0x00}, // # reg[ 1][ 18] = 0x00 ; Unmute LOL driver, 0dB Gain { 18,0x00}, // # reg[ 1][ 19] = 0x00 ; Unmute LOR driver, 0dB Gain { 19,0x00}, // # reg[ 1][ 9] = 0x3c ; Power up HPL/HPR and LOL/LOR drivers { 9,0x3C}, { 0,0x00}, // # reg[ 0][ 64] = 0x00 ; Unmute LDAC/RDAC { 64,0x00}, // # reg[0][82] = 0 { 82,0x00}, // # reg[0][83] = 0 { 83,0x00}, // # reg[0][86] = 32 { 86,0x20}, // # reg[0][87] = 254 { 87,0xFE}, // # reg[0][88] = 0 { 88,0x00}, // # reg[0][89] = 104 { 89,0x68}, // # reg[0][90] = 168 { 90,0xA8}, // # reg[0][91] = 6 { 91,0x06}, // # reg[0][92] = 0 { 92,0x00}, // # reg[0][84] = 0 { 84,0x00}, // # reg[0][94] = 32 { 94,0x20}, // # reg[0][95] = 254 { 95,0xFE}, // # reg[0][96] = 0 { 96,0x00}, // # reg[0][97] = 104 { 97,0x68}, // # reg[0][98] = 168 { 98,0xA8}, // # reg[0][99] = 6 { 99,0x06}, // # reg[0][100] = 0 {100,0x00}, {0, 0xFF}, };/}}}/ static const t_i2c_reg miniDSP_A_reg_values[] = { 。。。。 }; static const t_i2c_reg miniDSP_A_reg_values[] = { 。。。。 }; 0 本主题由 Harmony技术专家于 6 天前审核通过
7 天前　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 普罗旺斯的薰衣草该类别下有 44 个回答。邀请回答 heks 该类别下有 40 个回答。邀请回答潘涛12345 该类别下有 39 个回答。邀请回答新星之火12138 该类别下有 37 个回答。邀请回答霍威电源该类别下有 36 个回答。邀请回答 wanglinhua2627 该类别下有 35 个回答。邀请回答 fdhsfagd 该类别下有 33 个回答。邀请回答 chm5 该类别下有 33 个回答。邀请回答 wang21cj 该类别下有 31 个回答。邀请回答 HengDu 该类别下有 31 个回答。邀请回答 Tutut 该类别下有 30 个回答。邀请回答 zhouxk 该类别下有 29 个回答。邀请回答 ggfx 该类别下有 29 个回答。邀请回答 lksas 该类别下有 29 个回答。邀请回答 huzp_bbs 该类别下有 28 个回答。邀请回答深海零下一度1 该类别下有 28 个回答。邀请回答云汉007 该类别下有 28 个回答。邀请回答 yvochen 该类别下有 28 个回答。邀请回答 lifei639156 该类别下有 28 个回答，其中被选为最佳答案 1 次。邀请回答斌无非师范该类别下有 27 个回答。邀请回答举报吴湛相关推荐 • 请问AIC3254的I2S接口如何工作与TDM模式？ 83 • 请问PurePath无线开发套件master和slave两方是否需要采用同样的音频编解码器才能成功传输? 1665 • pps是否支持spi连接方式？ 221 • CC3200的wifi_audio_app工程加入AIC3254的dsp初始化寄存器数组，编译不通过？ 1367 • 请问为什么tlv320aic3254 使用minidsp无法正常录音？ 3109 • TLV320AIC3254调音量时在40%就开始破音,波形失真削顶/去底，怎么调寄存器的值？ 25 • 使用tlv320aic3254进行MIC数据采集，想使用一下codec内部的滤波算法，是不是可以用TI biquad生成参数就可以了？ 59 • AIC3254EVM-U在Tools-EPPROM Writer中选择firmware镜像将采样率改为16kHz，选其他文件点Program没有反应，为什么？ 100 • 在海思3536c上使用TLV320AIC3100遇到的疑问求解 51 • 求助，关于TLV320AIC3254初始化配置问题求解 101 2个回答

答案对人有帮助，有参考价值 0 1.你使用我们工具的方法都是对的。 2.编程写到自己的板子上去，首先要确认板子的连接和EVM一样，如果不一样，就得改代码。 3.芯片和McASP接口相连，不是用I2S格式，应该用DSP格式。也就是说： {0x1b,0x0c},//////// # I2S;16bit;BCLK output;WCLK output 这里要改。另外你是codec做主吧，我看你选的BCLK和WCLK都是输出，如果是做主，可以先看一下配置的有没有时钟。 4.看一下你的数据格式，看一下DM8168的音频格式有没有offset。

6 天前评论举报钱杨静

答案对人有帮助，有参考价值 0 从您的描述中，我了解到您正在测试AIC3254的环出功能，将模拟信号经过A/D转换、均衡器处理和D/A转换后，通过HeadPhone输出。您遇到了一些问题，无法正常工作。以下是一些建议和可能的解决方案： 1. 检查硬件连接：确保AIC3254与DM8168的McASP[0]之间的连接正确无误。检查电源、地线、数据线和时钟线是否正确连接。 2. 检查外部晶振：确保外部晶振的频率为24.576KHz，并且工作正常。您可以通过示波器检查晶振的输出波形。 3. 检查采样率设置：您提到设置采样率为44.1KHz。请确保AIC3254和DM8168的采样率设置正确，并且它们的时钟设置相匹配。 4. 检查时钟设置：根据您提供的时钟计算图，确保时钟设置正确。您可以通过示波器检查时钟信号的频率和相位是否正确。 5. 检查均衡器设置：确保均衡器的设置正确，包括滤波器类型、截止频率等。您可以尝试使用不同的均衡器设置，看看是否有改善。 6. 检查D/A转换器设置：确保D/A转换器的设置正确，包括分辨率、输出电压范围等。您可以尝试使用不同的D/A转换器设置，看看是否有改善。 7. 检查HeadPhone输出：确保HeadPhone输出的设置正确，包括音量、阻抗等。您可以尝试使用不同的HeadPhone输出设置，看看是否有改善。 8. 调试软件：检查您的软件代码，确保A/D转换、均衡器处理和D/A转换的逻辑正确。您可以尝试使用不同的软件算法，看看是否有改善。 9. 检查电源：确保AIC3254和DM8168的电源电压和电流满足要求。不稳定的电源可能会影响设备的正常工作。 10. 参考文档和示例代码：查阅AIC3254和DM8168的官方文档，了解它们的工作原理和配置方法。您还可以查找相关的示例代码，以便更好地理解如何配置和使用这些设备。希望以上建议对您有所帮助。如果问题仍然存在，请提供更多详细信息，以便我们为您提供更具体的解决方案。

6 天前评论举报安德森大