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4个回答
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罗伯托，
ds202.pdf，第22页，表44. CDR时间和时钟锁相时间列于数据手册中。 看起来像1.2ms，最大 Austin Lesea主要工程师Xilinx San Jose |
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亲爱的奥斯汀，
感谢您的回复。 假设必须恢复频率和相位，则给出该时间。 假设输入信号具有完全相同的频率（因为在Rx侧使用相同的参考时钟产生）并且相位相同（我可以用可变延迟线控制相位）。 您是否认为在这种情况下可以大大减少锁定时间？ |
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p，
我什么都不知道。 如果您发现在某些条件下，时间较短，则不是Xilinx指定的内容，因此您可以独立完成。 Austin Lesea主要工程师Xilinx San Jose |
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假设由于同步设计，输入数据的相位差非常小，
你可以期待CDR锁定得更快。 但CDR是一个模拟电路，并且正在阻止数据 与0相位差完全同步，您应该期望每次测试时锁定时间都不同。 假设CDR可以处理的最大相位差，DS中给出的值是最大值。 希望有所帮助。 MADHUKAR |
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只有小组成员才能发言，加入小组>>
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