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你好
我在Zynq 7010设计上添加了一个UART 16550 IP，中断直接连接到Zynq INTC。 在petalinux中导入硬件设计后，pl.dtsi结构似乎没问题，但是当我编译图像并启动板（Microzed板）时，我找不到任何/ dev / ttyS0节点。 UARTLITE也是如此（没有/ dev / ttyUL *）。 我正在使用Vivado 2014.4 任何人都可以帮助找出我做错了什么？ 谢谢 G。 pl.dtsi 1 KB 
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2个回答
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很难确切地说出发生了什么，没有足够的信息。
生成的pl.dtsi通常没问题。 这里有一些提示： - 确保uart也有：status =“okay”; 在system-top.dts或pcw.dtsi中 - 在内核中，启用“Open Firmware platform bus上的串行端口”（设备驱动程序 - >字符 - >串行）以及8250/16550或uartlite驱动程序 - uartlite端口将显示为/ dev / ttyUL0 |
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喜
2014.4有一个已知问题。 你可以参考这个AR吗？http：//www.xilinx.com/support/answers/64339.html --hs -------------------------------------------------- --------------------------------------------请注意 - 请注明 如果提供的信息有用，请回答“接受为解决方案”。给予您认为有用并回复导向的帖子。感谢K-- -------------------------------------------------- --------------------- |
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