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电子发烧友论坛
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嗨，大家好，
我使用creat和package IP来创建我的个人IP，然后我想在IP包中编辑我的IP，但每次在IP packager项目中，它都会生成两个verlog文件。 我想知道两个如何将这些verilog文件更改为vhdl格式。 谢谢。 
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3个回答
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嗨，
你在谈论哪些文件？ 它们包含什么？ 谢谢， 迪皮卡。 谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题 张贴。 如果某人的帖子回答了您的问题，请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子，考虑给它Kudos（左边的明星） |
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嗨，迪迪卡，对不起，我的问题不明确。
在外围设备创建过程中创建的文件。 一个是顶级架构文件，我们可以在其中定义用户I / O. 另一个包含功能AXI接口。 所有这些文件都是由我的设计中的verilog编写的，我想将它们更改为VHDL。 谢谢。 |
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嗨，
在项目设置中，将目标语言更改为VHDL并重新生成IP文件。 谢谢， 迪皮卡。 谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题 张贴。 如果某人的帖子回答了您的问题，请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子，考虑给它Kudos（左边的明星） |
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