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您好,帖子路由模拟是否按预期工作?问候,Pratham
-Pratham ------------------------------------------------ ----------------------------------------------请注意 - 请 如果提供的信息有用,请将答案标记为“接受为解决方案”。给予您认为有用并回复导向的帖子。感谢K- -------------------------------------------------- ----------------------- |
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嗨,
如果您有任何具有硬件评估许可证的IP,也可能发生这种情况,请分享我们有关您设计的更多详细信息,以便我们为您提供更多帮助。 问候, Vanitha。 -------------------------------------------------- -------------------------------------------请在发布前进行谷歌搜索, 您可能会找到相关信息。请留下帖子 - “接受为解决方案”,如果提供的信息有用且回复,请给予赞誉 |
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嗨,
约束的时间松弛是什么? 跨时钟域路径是否受到限制? 这可能是元稳定性的问题。 设计中是否包含系统抖动约束? 我假设您的设计满足时序,并且硬件设计失败。 如果这是正确的,请遵循本文档第234页中给出的建议 --HS -------------------------------------------------- --------------------------------------------请注意 - 请注明 如果提供的信息有用,请回答“接受为解决方案”。给予您认为有用并回复导向的帖子。感谢K-- -------------------------------------------------- --------------------- |
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只有小组成员才能发言,加入小组>>
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Spartan 3-AN时钟和VHDL让ISE合成时出现错误该怎么办?
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如何在RTL或xilinx spartan fpga的约束文件中插入1.56ns延迟缓冲区?
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有输入,但是LVDS_25的FPGA内部接收不到数据,为什么?
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在使用xc5vsx95T时JTAG扫片不成功,测量TDO无信号输出
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