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FPGA实现乘法运算（直接用符号*和用IP的区别）

yangtuzi2016

2016-3-9 19:58:42 12125

0 仿真工具:Vivado 2015.1 目标器件:xc7a100tfgg484-2 仿真代码： module test_sim( ); reg sys_clk; reg rst_n; reg [7:0] a; reg [7:0] b; reg [8:0] c; reg [9:0] d; reg [17:0] e; reg [7:0] temp1; reg [17:0] temp2; wire[17:0] mult_out; initial begin sys_clk = 0; rst_n = 0; #30 rst_n = 1; a = 'd54; b = 'd1; d = 'h1e0; end always #5 sys_clk = ~sys_clk; mult_test mult_test ( .CLK(sys_clk), .A((~c[7:0]) + 8'b0000_0001), .B(d), .P(mult_out) ); always @(posedge sys_clk) begin a <= a+'d1; b <= b+ 'd2; c <= {1'b0,a} - {1'b0,b}; temp1 <= ((~c[7:0]) + 8'b0000_0001); temp2 <= ((~c[7:0]) + 8'b0000_0001) * d; e <= c[8]? (((~c[7:0]) + 8'b0000_0001) * d) : (c[7:0] * d); end endmodule 仿真波形截图：可见：当a为3c，b为0d时，c <= {1'b0,a} - {1'b0,b};得到2f；延一拍，temp1的值为d1（取反加1的结果） d1 * 1e0 = 187e0，IP输出的结果mult_out正确，temp2得到值3a7e0，错误。所以，涉及到负数乘法处理时，用IP较好。 0 1.jpg (32.88 KB, 下载次数: 16)
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