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2020-8-27 07:54:54
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2020-8-27 08:14:29
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喜@ kumarmurugan
HI Kumar，您能否在抽象层面告诉我如何在FPGA和两个sram模块之间实现同步。 重新设计PCB布线，这完全取决于您如何设计PCB堆栈和重新分级PCB指南线，请参阅https://www.xilinx.com/support/documentation/user_guides/ug483_7Series_PCB.pdf。 谢谢＆amp; Regrads s.chandra sekhar |
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@csattarHi
基本上FPGA和所有外设决定以200MHz运行。 SRAM读/写将发生在管道激情中。 SRAM之间的读/写地址都不匹配。 但它将是一个顺序读/写操作。 并且在一个周期内没有在同一SRAM中读/写（周期意味着说N个时钟周期）。 就像SRAM 1用于读取时那样，SRAM 2用于在下一个周期中写入数据，反之亦然。 |
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