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[问答]

Vivado 2014.3无法写入以前工作项目的比特流怎么解决？

1972

问答对人有帮助，内容完整，我也想知道答案 0 你好，自从我更新到新版本的Vivado 2014.3后，我无法写入以前工作项目的比特流。我现在收到以下错误消息： [DRC 23-20]规则违反（REQP-1584）GTxE2 PLLLOCKDETCLK不能REFCLK - GTXE2_CHANNEL销device_i / INTERNAL_PHY_USED.fsl_phy_i / XILINX_GEN.tx_serdes_i / i_ku_cxp_gt4_init / i_ku_cxp_gt4 / i_ku_cxp_gt4_multi_gt / gt0_gt4_i / gtxe2_i / CPLLLOCKDETCLK不能由时钟驱动衍生来自用作CPLL参考时钟的相同时钟，包括TXOUTCLK ，RXOUTCLK ，提供参考时钟的IBUFDS_GTE2的输出，以及这些时钟输出的任何缓冲或相乘/分频版本。有关更多信息，请参阅UG476。通过时钟缓冲器的源与GT单元参考时钟相同。 [DRC 23-20]规则违反（REQP-1584）GTxE2 PLLLOCKDETCLK不能REFCLK - GTXE2_COMMON销device_i / INTERNAL_PHY_USED.fsl_phy_i / XILINX_GEN.tx_serdes_i / i_ku_cxp_gt4_init / i_ku_cxp_gt4 / i_ku_cxp_gt4_multi_gt / gtxe2_common_0_i / QPLLLOCKDETCLK不能由从得到的时钟来驱动相同的时钟用作QPLL的参考时钟，包括TXOUTCLK ，RXOUTCLK ，提供参考时钟的IBUFDS_GTE2的输出，以及这些时钟输出的任何缓冲或相乘/分频版本。有关更多信息，请参阅UG476。通过时钟缓冲器的源与GT单元参考时钟相同。该项目刚刚在Vivado 2014.1上找到（我从未尝试在2014.2版本上运行它）。有没有人遇到这个问题，知道如何解决它？有可能tosafely忽略这个DRC错误？ 0
2020-7-25 09:48:53　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × asd008 该类别下有 32 个回答。邀请回答 aaaa321 该类别下有 27 个回答。邀请回答 doublelove 该类别下有 26 个回答。邀请回答 vynywrwr 该类别下有 21 个回答。邀请回答 hgjhgd 该类别下有 19 个回答。邀请回答 bwerwer 该类别下有 18 个回答。邀请回答 hanyan533 该类别下有 18 个回答。邀请回答 Jaionm 该类别下有 18 个回答。邀请回答 wang2222222 该类别下有 17 个回答。邀请回答 handsomelchcpp 该类别下有 17 个回答。邀请回答 binro 该类别下有 16 个回答。邀请回答 ningee 该类别下有 16 个回答。邀请回答 wznnzw 该类别下有 15 个回答。邀请回答 myf888 该类别下有 15 个回答。邀请回答 zcy615 该类别下有 14 个回答。邀请回答 wanglinhua2627 该类别下有 14 个回答。邀请回答 guotong1984 该类别下有 14 个回答。邀请回答 yhxc 该类别下有 14 个回答。邀请回答 armortech 该类别下有 14 个回答。邀请回答 60user25 该类别下有 14 个回答。邀请回答举报余小娟相关推荐 • Vivado 2015.2新的比特流生成后同一程序无法正常工作？ 2051 • 请问如何在Vivado中更改比特流文件的位置？ 12818 • 如何使用Vivado生成特定的部分比特流 3555 • Vivado项目生成比特流时发生错误 9795 • 无法生成比特流 3349 • 在artix7上使用ICAP进行部分比特流编程问题的解决办法？ 1871 • Vivado 2014.3无法申请评估许可证 2515 • 中途向ICAP中止写入部分比特流 1561 • 比特流是什么 4994 • 请问ZCU102 ES2能进行比特流加密吗？ 1388 9个回答

答案对人有帮助，有参考价值 0 如果您没有额外的时钟，您也可以为PLLLOCKDETCLK提供1'b0。丹尼尔在原帖中查看解决方案

2020-7-25 10:06:57 评论举报李熙国

答案对人有帮助，有参考价值 0 此错误有效。看起来这个DRC在早期版本的工具中不存在。您应该使用自由运行的时钟作为PLLLOCKDETCLK的源。如果使用TXOUTCLK或RXOUTCLK，则可能导致循环，并且可能无法在硬件上实现CPLL / QPLL锁定。 -------------------------------------------------- ----------------------------别忘了回复，给予kudo并接受为解决方案--------- -------------------------------------------------- -------------------

2020-7-25 10:16:52 评论举报贾佳斌

答案对人有帮助，有参考价值 0 如果您没有额外的时钟，您也可以为PLLLOCKDETCLK提供1'b0。丹尼尔

2020-7-25 10:33:59 评论举报李熙国

答案对人有帮助，有参考价值 0 我在系统中使用TX RX时钟，但PLLLOCKDETCLK连接到外部125MHz时钟（通过一些缓冲器），所以我没有看到它有什么问题。你能解释一下吗？

2020-7-25 10:41:21 评论举报王伟鹏

答案对人有帮助，有参考价值 0 125 MHz外部时钟是否也将其他时钟驱动到GT中？比如驾驶QPLL或驾驶驾驶GT的MMCM？丹尼尔

2020-7-25 10:56:32 评论举报李熙国

答案对人有帮助，有参考价值 0 是的，所有的时钟。我从电路板上得到一个125Mhz（差分）时钟。我将它连接到aIBUFDS_GTE2模块，它（通过一些缓冲区）到我项目中的所有时钟，包括GT时钟。

2020-7-25 11:08:02 评论举报王伟鹏

答案对人有帮助，有参考价值 0 我在theug476_7Series_Transceivers中读到，如果你不使用QPLLFBCLKLOST和QPLLREFCLKLOST，你不需要QPLLLOCKDETCLK和CPLLLOCKDETCLK（对于CPLLFBCLKLOST和CPLLREFCLKLOST）。我不使用CPLLFBCLKLOST和CPLLREFCLKLOST，因此我不需要CPLLLOCKDETCLK（将其连接到常量1'b0）但我确实使用了QPLLREFCLKLOST，因此我不能对QPLLLOCKDETCLK执行相同的操作。我确实尝试将它连接到一个恒定的1'b0但GT停止工作。有什么建议吗？

2020-7-25 11:24:57 评论举报王伟鹏

答案对人有帮助，有参考价值 0 我没有使用CPLLLOCKDETCLK或QPLLLOCKDETCLK，GT正在为我工作。请注意，CPLLLOCKDETCLK一直向下到GT？E2_CHANNEL模块。 QPLLLOCKDETCLK转到GT？E2_COMMON模块，该模块可以位于层次结构中的不同位置，具体取决于您选择的选项。当你把QPLLLOCKDETCLK送到QPLLLOCKDETCLK时，我会找到COMMON模块并在模拟中观察它。如果您只有一个时钟，QPLLREFCLKLOST无法帮助您，因为如果您丢失了唯一的时钟，那么任何事情都无济于事。如果你想知道的是QPLL被锁定并准备好使用，你可以将QPLL LOCK信号拉出COMMON模块。丹尼尔

2020-7-25 11:35:00 评论举报李熙国

答案对人有帮助，有参考价值 0 我把CPLLLOCKDETCLK置于一个恒定的高电平并连接另一个时钟用于QPLLLOCKDETCLK（来自KC705评估板的系统时钟），到目前为止它似乎对我来说还可以。谢谢你们！

2020-7-25 11:50:51 评论举报王伟鹏

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