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大家好，
我在artix7上使用ICAP进行部分比特流编程时遇到问题。 我有一个静态和部分比特流，当用jtag编程时工作正常，所以比特流似乎没问题。 我可以通过icap触发Multiboot，所以我假设ICAP是正确推断的。 我确实运行了模拟比特流加载，一切看起来都还可以。 但是，当我通过icap编程部分比特流时，设计的行为与使用jtag进行编程时的行为不同 - 有些指示灯应该不应该假设。 Icap编程在25MHz的自由运行clk模式下完成。 我不知道如何调试这个。 我可以以某种方式回读FPGA比特流，看看差异在哪里。 我记得这对ise / impact来说是不可能的，因为比特流在回读时会以某种方式被修改 - 是否有可能用vivado做到这一点？ 问候 Klemen 
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2个回答
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谢谢您的回复，
正如我所说，我有一个静态和部分比特流，当用jtag编程时工作正常，所以两个比特流似乎都没问题。 我正在使用.bit for jtag和.bin（没有标题）for icap。 我相信比特流是正确的，除非vaivado jtag程序员以某种方式修改比特流，但我认为它没有。 是否有可能以某种方式嗅探jtag在icap发送的数据？ |
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