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E,
时序报告会将DCM创建的抖动添加到总抖动中(您必须在时钟输入上指定抖动,因此也会添加)。 如果我记得,乘以10除以1,可能会增加300到500 ps的抖动。 在ppeak中“加”到峰值意味着你取所有峰值到峰值的平方和的平方根,得到峰峰值的答案(峰值到峰值平方增加,RMS会加算算,但我们不要 不指定RMS,我们指定峰到峰)。 因此,100 ps时钟输入抖动加上500 ps CLKFX,峰峰值为510 ps ...... 只有一半会影响您的时序余量(负峰值会使周期变小),因此必须具有松弛的时钟周期不再是10 ns(100 MHz)减去100 ps的1/2,而是10ns, - 255ps( 9.74ns)。 无论如何,这些工具可以解决这个问题,所以你不必这样做。 总是只需要稍微松弛(时间余量)。 0松弛就在边缘,所以我喜欢至少有100ps的松弛(仅略微超过要求)。 负松弛意味着你无法满足时机要求。 Austin Lesea主要工程师Xilinx San Jose 在原帖中查看解决方案 |
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我应该问“增加多少抖动......”
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时序报告会将DCM创建的抖动添加到总抖动中(您必须在时钟输入上指定抖动,因此也会添加)。 如果我记得,乘以10除以1,可能会增加300到500 ps的抖动。 在ppeak中“加”到峰值意味着你取所有峰值到峰值的平方和的平方根,得到峰峰值的答案(峰值到峰值平方增加,RMS会加算算,但我们不要 不指定RMS,我们指定峰到峰)。 因此,100 ps时钟输入抖动加上500 ps CLKFX,峰峰值为510 ps ...... 只有一半会影响您的时序余量(负峰值会使周期变小),因此必须具有松弛的时钟周期不再是10 ns(100 MHz)减去100 ps的1/2,而是10ns, - 255ps( 9.74ns)。 无论如何,这些工具可以解决这个问题,所以你不必这样做。 总是只需要稍微松弛(时间余量)。 0松弛就在边缘,所以我喜欢至少有100ps的松弛(仅略微超过要求)。 负松弛意味着你无法满足时机要求。 Austin Lesea主要工程师Xilinx San Jose |
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您可以将参数从Core Generator插入时钟向导,该工具将计算输出时钟的抖动量(请参阅附加快照)
eliascm写道: 如果我将一个10 MHz时钟输入到DCM_ADV并将其乘以10.0,那么我在100 MHz时钟输出上可以获得多少抖动? 干杯,吉姆 |
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只有小组成员才能发言,加入小组>>
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Spartan 3-AN时钟和VHDL让ISE合成时出现错误该怎么办?
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求一块XILINX开发板KC705,VC707,KC105和KCU1500
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