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大家好，
我正在为我的设计使用AXI_ethernet 1.25 / 2.5 Gbps IP内核。我正在设计它的1.25 Gbps数据速率。 我的设计适用于后实现时序仿真，但是当我在FPGA上生成位文件和转储时，我无法看到输出。 这里我使用的是1.25Gbps的SFP光收发模块。 是否有任何条件/约束要考虑使SFP启用？ FPGA = Kintex 7系列xc7k160tfbg484-2 SFP = FTLF8524P3BNL（Finisar） IP核= AXI 1G / 2.5G以太网子系统7.0 以太网速度= 1Gbps 物理接口选择= 1000 BaseX 温暖的问候， Nishant Angadi 
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7个回答
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你能尝试将GT设置为环回模式吗？
这有助于确认设计是否正确移植到电路板上。 -------------------------------------------------- ----------------------------别忘了回复，给予kudo并接受为解决方案--------- -------------------------------------------------- ------------------- |
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你好
当你说没有输出时，你如何以及在何处监控这些数据。 它是在ILA或远端链接吗？ SFP模块将具有SFP使能/ TX禁用引脚，请仔细检查是否未禁用此功能。 问候， 萨蒂什 问候，萨蒂什----------------------------------------------- --- --------------------------------------------请注意 - 如果提供的信息有用，请将答案标记为“接受为解决方案”。给予您认为有用的帖子。感谢.-- ---------------------------- --------------------- ---------------------- |
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嗨Venkata，
内部环回模式在后实现时序仿真中工作正常。 但在硬件上它不会。 设计定制数据接收器，它比较Tx和Rx数据，如果两者匹配则有效输出信号将被触发为高。 我通过使能PCS PMA内部管理寄存器的第14位（pg138_axi_ethernet）来启用内部环回。 以下附件包括注册配置详细信息。 请告诉我，如果需要修改或需要任何其他信息。 感谢致敬， Nishant Angadi Register_configuration.txt 5 KB |
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嗨satish，如何检查SFP启用/ TX禁用引脚？
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你好
检查硬件中的SFP引脚连接，如果是硬连线或使用跳线设置此连接。 问候，萨蒂什----------------------------------------------- --- --------------------------------------------请注意 - 如果提供的信息有用，请将答案标记为“接受为解决方案”。给予您认为有用的帖子。感谢.-- ---------------------------- --------------------- ---------------------- |
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你好
他们的电路板上有连接器吗？ 你把SFP插在笼子里的哪个位置？ 你能发布它的快照吗？ 问候，萨蒂什----------------------------------------------- --- --------------------------------------------请注意 - 如果提供的信息有用，请将答案标记为“接受为解决方案”。给予您认为有用的帖子。感谢.-- ---------------------------- --------------------- ---------------------- |
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只有小组成员才能发言，加入小组>>
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