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我的固件代码在3个FPGA中的一个FPGA上出现问题。
应用程序明智的代码在两个virtex 5 FPGA上正常工作,但一个FPGA数据与其他FPGA数据相比不正确。 所有FPGA都是相同的。 FPGA片利用率为94%。 这会导致问题吗? 在构建我的vhdl代码之后,我得到PPC时钟发生器输出SIG_PLL1_CLKOUT1的一个定时错误,其中检测到28个设置定时错误。 对于两个FPGA,这仍然是一个正常的位文件,但对于1个FPGA数据输出是不合适的。 当我添加chipcope来检查数据在哪里损坏时没有时序错误,并且固件对所有三个FPGA都工作正常。 我无法弄清楚实际问题是什么。 |
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1个回答
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嗨,
由于存在28个设置违规,因此在将生成的BITFILE用于硬件之前需要先修复这些设置。 现在为什么具有相同BITFILE的2 FPGA正在工作以及为什么1导致问题,更可能是由于电路板的条件不同。 噪声效应以及PVT可能有助于2 FPGA,但在其他情况下会导致问题。 我仍然不能具体评论它的问题。 我的建议是,修复时间得到100%通过定时Bitfile然后在硬件上使用它。 如果您需要有关如何修复时间的建议,请分享您的时间报告。 谢谢,佳日 |
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