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在ISE 14.7中 - 对于spartan 6 FPGA，在综合顶层模块设计时，会显示以下错误消息
“INTERNAL_ERROR：Xst：cmain.c：3423：1.29 - 流程将终止。有关此问题的技术支持，请在http://www.xilinx.com/support./-更改时打开此项目附带的WebCase 综合属性 - >保持层次结构 - >“软”。 但是使用默认属性，合成时没有任何错误消息。 谁能知道解决这个问题的解决方案？ 
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6个回答
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然后它是工具中的一个错误。
由于ISE处于维护模式，我们将无法纠正此错误。 因此，唯一的解决方法是将flatten_hierarchy设置为yes。 谢谢，Nupur ----------------------------------------------- --------------------------------------------- Google在发布之前提问 。 如果某人的帖子回答了您的问题，请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子，考虑给它Kudos（点击星标）。 |
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嗨@ ramkumarsairam，
所以问题在于顶层模块。 是否可以共享顶级模块文件？ 谢谢，Arpan 谢谢，Arpan ----------------------------------------------- - - - - - - - - - - - - - - - - - - - - - - - -请注意- 如果提供的信息有用，请将答案标记为“接受为解决方案”。给予您认为有用且回复的帖子。感谢Kudos .-------------------- -------------------------------------------------- ------------------------ |
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嗨arpansur，
对不起，我没有许可分享。 只有将层次结构更改为软或是，才会出现错误。 您能否通过更改层次结构列出错误的可能性？ 对于芯片内窥镜分析，我需要内部信号进行监控。 |
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很高兴知道您的问题已得到解决。
因此，请根据其他用户的利益将您的回复标记为解决方案来关闭此主题。 谢谢，Nupur ----------------------------------------------- --------------------------------------------- Google在发布之前提问 。 如果某人的帖子回答了您的问题，请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子，考虑给它Kudos（点击星标）。 |
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只有小组成员才能发言，加入小组>>
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