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大家好,
我正在开发源同步串行接口。 当我输出串行数据时,我陷入了OFFSET OUT timing。 我正在使用IOB寄存器来获取数据,并使用ODDR2(180度相移)作为时钟。 使用MMCM生成为ODDR2提供时钟的时钟。 我尝试了不同的OFFSET OUT约束,但总是会忽略约束。 但是,我遇到了这个答案,并根据答案记录对我的约束进行了建模。 http://www.xilinx.com/support/answers/34294.htm 以下是我的细读限制。 NET“up_clk”TNM_NET = up_clk; TIMESPEC TS_up_clk = PERIOD“up_clk”12.531 ns HIGH 50%; NET“dn_d”TNM = downlink_data_clk; NET“dn_clk”TNM = downlink_data_clk; INST“downlink_head / serial_tx / o_ser_data”TNM = downlink_data_clk_reg; INST“downlink_head / serial_tx / serial_clock”TNM = downlink_data_clk_reg; TIMEGRP“downlink_data_clk”OFFSET = OUT在“up_clk”之后REFERENCE_PIN“dn_clk”TIMEGRP“downlink_data_clk_reg”; 约束不再被忽略。 但是,我不确定如何解释结果。 您能否向我解释或指出任何解释结果的文件。 报告的结果如下: 以上来自于谷歌翻译 以下为原文 Hello All, I am working on a source synchronous serial interface. As I am outputing serial data, I am intersted in the OFFSET OUT Timing. I am using a IOB register for data and a ODDR2 (180 degree phase shifted) for the clock. The clock that clocks the ODDR2 is generated using a MMCM. I tried different OFFSET OUT constraints but the constraint would always be ignored. However, I came across this answer and modelled my constraints based on the answer record. http://www.xilinx.com/support/answers/34294.htm Here are my constraints for your perusal. NET "up_clk" TNM_NET = up_clk; TIMESPEC TS_up_clk = PERIOD "up_clk" 12.531 ns HIGH 50%; NET "dn_d" TNM = downlink_data_clk; NET "dn_clk" TNM = downlink_data_clk; INST "downlink_head/serial_tx/o_ser_data" TNM = downlink_data_clk_reg; INST "downlink_head/serial_tx/serial_clock" TNM = downlink_data_clk_reg; TIMEGRP "downlink_data_clk" OFFSET = OUT AFTER "up_clk" REFERENCE_PIN "dn_clk" TIMEGRP "downlink_data_clk_reg"; The constraints are not ignored anymore. However, I am not sure how to interpret the results. Can you please explain or point me to any documentation that explains the results. The results as reported is below: |
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