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你好，
我尝试在PSoC 3/5上实现8位SPI从属，并使用4字节硬件FIFO。根据数据表，由于我有CPHA＝＝0，所以我必须使用SPISTWORIGETXDATAZORE（）直接向移位寄存器写入第一个输出字节。这个操作如何影响FIFO？换句话说，如果我有一个空的TX FIFO，然后通过SPISTWORIGETXDATAZORE（）写入，FIFO还是空的吗？如果是，我能在第一个数据时钟边沿被接收之前使用4个SPISTWORGETXDATA（）操作来填充它吗？ 以上来自于百度翻译 以下为原文 Hi, I'm trying to implement an 8-bit SPI slave on PSoC 3/5 and use the 4-byte hardware FIFO. According to the data sheet, since I have CPHA==0, I must write directly to the shift register using SPIS_WriteTxDataZero() for the first outgoing byte. How does this operation affect the FIFO? In other words, if I have an empty Tx FIFO and then write via SPIS_WriteTxDataZero(), is the FIFO still empty? If so, can I fill it up using 4 SPIS_WriteTxData() operations before the first data clock edge is even received? 
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我不会修正4的FIFO深度。有PSOs有16级深FIFO。您总是可以查询FIFO满的组件。
写作直接进入转移登记不占用FIFO输入。 鲍勃 以上来自于百度翻译 以下为原文 I would not fix to a FIFO depth of 4. There are PSoCs that have got a 16 level deep FIFO. You can always query the component for FIFO full. Writing directly into the transfer register does not occupy a FIFO entry. Bob |
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