完善资料让更多小伙伴认识你，还能领取20积分哦， 立即完善>
3天内不再提示
|
使用NI的 FPGA，开辟了一个1294*1040大小的DRAM，在60HZ帧频下按地址一个MCK一个地址的刷新DRAM中的数据，也就是每个地址刷新时间不到17微秒，一开始出现一个数据都写不进去，我通过实验发现DRAM刷新数据有延迟，这个是任何资料都没有写到的，我通过奇偶间隔刷新方式解决了，但连续刷新数据超过54个时钟整个DRAM就会出现整体错位情况，请问DRAM还有什么特性我不知道会导致此现象？
0
已退回40积分
|
|
相关推荐
3个回答
|
|
|
是不是 线连错了！！！！！！！！！！！
|
|
|
|
|
|
已经解决了，知道原因了，已经解决了，知道原因了，
|
|
|
|
|
你正在撰写答案
如果你是对答案或其他答案精选点评或询问，请使用“评论”功能。
NVMe高速传输之摆脱XDMA设计50：主要功能测试结果与分析2 nvmePCIe高速存储
252 浏览 0 评论
NVMe高速传输之摆脱XDMA设计49：主要功能测试结果与分析1
1501 浏览 0 评论
907 浏览 0 评论
855 浏览 0 评论
658 浏览 0 评论
4426 浏览 63 评论
/9 
关注我们的微信
下载发烧友APP
电子发烧友观察
版权所有 © 湖南华秋数字科技有限公司
电子发烧友 （电路图） 湘公网安备 43011202000918 号 电信与信息服务业务经营许可证：合字B2-20210191
工商网监
湘ICP备2023018690号
3772
评论
淘帖
3377
赞
