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使用user design文件夹下的.v文件，如果编写顶层读写控制程序对mig-39-2.v进行例化，如何操作才能使用sim_tb_top.v仿真文件？

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问答对人有帮助，内容完整，我也想知道答案 0 本帖最后由一只耳朵怪于 2018-6-22 17:45 编辑最近在学习DDR3的使用，用的是xilinx的mig-39-2 IP核，仿真并下板调试了example design文件夹里的例子，ddr正常。但实际是要使用user design文件夹下的.v文件，此时如果编写顶层读写控制程序对mig-39-2.v进行例化，应如何操作才能使用sim_tb_top.v仿真文件，（直接编写一个顶层tb文件，calibration done一直为低）其实就是，我应如何编写mig的读写控制程序，才能使用其提供的仿真文件对其进行modelsim仿真。还望高手不吝赐教（江湖救急！！！） 0
2018-6-22 17:14:40　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 刘英该类别下有 31 个回答。邀请回答 chenbingjy 该类别下有 27 个回答。邀请回答 yoonssica 该类别下有 22 个回答。邀请回答 houxiaoxiao 该类别下有 17 个回答。邀请回答小工兵该类别下有 16 个回答。邀请回答小萃米该类别下有 16 个回答。邀请回答 Elecfans管家该类别下有 15 个回答。邀请回答薄迪该类别下有 14 个回答。邀请回答我爱妖妖该类别下有 14 个回答。邀请回答言尽于此33 该类别下有 14 个回答。邀请回答 hxing 该类别下有 13 个回答。邀请回答那些年儿ing 该类别下有 13 个回答。邀请回答平漂流该类别下有 13 个回答。邀请回答科比如我该类别下有 12 个回答。邀请回答倪love 该类别下有 12 个回答。邀请回答 1653344032.827400 该类别下有 12 个回答。邀请回答 xiekaboy 该类别下有 12 个回答。邀请回答小麦地该类别下有 12 个回答。邀请回答 2013crazy 该类别下有 11 个回答。邀请回答英雄孤寂该类别下有 11 个回答。邀请回答举报叉叉相关推荐 • 更改sim_tb_top.v没有成功的解决办法？ 932 • 如何在sim_tb_top中模拟两个FPGA芯片2芯片接口？ 1446 • 没有用于存储器端口FIFO的驱动时钟信号 1747 • 使用nuclei stuio将软件程序编为.Verilog，在vivado中仿真出现的问题求解 545 • Modelsim是如何运行example_design的？ 2050 • 没有参数SAMPLES和OCAL_SIMPLE_SCAN_SAMPS怎么办？ 969 • FPGA例化问题？ 2937 • 关于E203v2使用vivado进行仿真跑helloworld的时钟频率问题 546 • 如何使用modelsim仿真？ 3956 • 关于quartus ii 如何将不同project下的文件放到一起进行连线、综合？求解 18975 4个回答

回帖奖励 +5 分积分答案对人有帮助，有参考价值 0 学习学习。。。。

2018-6-22 21:00:12 评论举报 CHNlyt

答案对人有帮助，有参考价值 0 你直接按照AXI4协议的进行读写就可以了

2018-6-24 13:24:02 评论举报黑桃ACE

答案对人有帮助，有参考价值 0 黑桃ACE 发表于 2018-6-24 13:24 你直接按照AXI4协议的进行读写就可以了 AXI4协议？这个没用过

2018-6-25 09:29:09 评论举报叉叉

答案对人有帮助，有参考价值 0 已解决，想的太复杂了，对照example design修改就可以了

2018-7-10 13:30:08 评论举报叉叉

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