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石俊梅

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他的提问 34 他的回答 664 去回答

回答了问题 2020-4-26 09:10

启动chipcope进行调试出现等待核心武装，缓慢或停止时钟如何解决？

letian575

你好@ us000072 ILA时钟输入应连接到自由运行时钟。你能打开合成设计并检查是什么驱动ILA时钟引脚吗？谢谢，迪皮卡.---------------------------------------------- ------------------------------------------ ...
回答了问题 2020-4-26 08:42

请问如何管理XDC文件和顶级中的生成时钟？

h1654155958.0520

Himo7amed_elhady@yahoo.com 我没有看到附加的DCP文件中的任何MMCM实例。你在RTL中实例化了MMCM吗？谢谢，迪皮卡.---------------------------------------------- -------------------------------------------- ...
回答了问题 2020-4-24 09:13

BRAM阅读访问出现错误的原因？

pingfandeshijie

你好@ deepakddn 看起来您在SDP模式下使用BRAM并执行写入和从端口-B读取。你能上传完整的模拟转储吗？可能是VCD格式？此外，如果您正在使用块内存生成器IP，则上载相同的XCI文件。谢谢，迪皮卡.---------------- ...
回答了问题 2020-4-24 08:44

使用vivado 2015.4为什么需要将BUFG放在设备的同一半侧？

tjgf

你好@ 040339970 这是架构限制。 MMCM仅在同一半时钟区域内与BUFG站点建立专用连接。谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前 ...
回答了问题 2020-4-24 08:14

使用vivado 2015.4为什么需要将BUFG放在设备的同一半侧？

tjgf

你好@ 040339970 你的XDC文件中的BUFG实例（在错误中提到）有LOC限制吗？谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题张贴。 ...
回答了问题 2020-4-23 08:16

IOdelayCTRL的新pbme出现错误怎么解决？

selinali0112

你好@ dtebourski 看起来实例名称已更改，请尝试使用以下命令 set_property IODELAY_GROUP CONTROLLER_DDR3_SDRAM_IODELAY_MIG0 [get_cells inst_wrapper / inst_lvds_prod_3 / inst_selctIO_prodLVDS_input / inst ...
回答了问题 2020-4-23 08:07

IOdelayCTRL的新pbme出现错误怎么解决？

selinali0112

你好@ dtebourski 看起来实例名称已更改，请尝试使用以下命令 set_property IODELAY_GROUP CONTROLLER_DDR3_SDRAM_IODELAY_MIG0 [get_cells inst_wrapper / inst_lvds_prod_3 / inst_selctIO_prodLVDS_input / inst ...
回答了问题 2020-4-21 10:14

Virtex 5布局布线错误

诺诺滴乖乖

你好@ ***atchu1 您的设计中有多少个DCM和PLL实例？错误中提到的PLL实例是否也连接到其他DCM实例？每个CMT有2个DCM和1个PLL站点。您不能级联超过此数字。有关此专用连接的详细信息，请参阅http://www.xilinx.com ...
回答了问题 2020-4-21 09:37

怎么使用网表进行kintex 7？

wtrwefsdf

你好@ xlkarthik Kintex-7 EDIF应该没问题。谢谢，迪皮卡。谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题张贴。如果某人的 ...
回答了问题 2020-4-21 08:57

怎么使用网表进行kintex 7？

wtrwefsdf

你好@ xlkarthik Kintex-7 EDIF应该没问题。谢谢，迪皮卡。谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题张贴。如果某人的 ...
回答了问题 2020-4-21 07:29

怎么将HDL源文件添加到Xilinx IP？

60user148

你好@ deepakmmathew 这有帮助吗？谢谢，迪皮卡。谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题张贴。如果某人的帖子回答 ...
回答了问题 2020-4-21 07:13

怎么将HDL源文件添加到Xilinx IP？

60user148

你好@ deepakmmathew 您无法以这种方式添加源文件。 “托管”属性允许用户编辑IP RTL但您无法添加RTL。而不是添加单独的文件包括直接在其中一个IP RTL文件中的代码。谢谢，迪皮卡。谢谢，迪皮卡.--------------- ...
回答了问题 2020-4-17 08:38

RC-STAT1未完全路由

naiztycheng

Hi@kannan.govindasamy 以下时钟端口被锁定到导致该问题的相同IO存储体127或时钟区域x0y3。 HDMI_RX_CLK_P_IN HDMI_RX_CLK_N_IN DRU_CLK_IN_clk_p DRU_CLK_IN_clk_n 尝试将DRU_CLK_IN_clk_p和DRU_CLK_IN_clk_n端口锁 ...
回答了问题 2020-4-17 08:00

RC-STAT1未完全路由

naiztycheng

Hi@kannan.govindasamy 我看到你在时钟区X0Y3中使用下面的IBUFDS_GTE3缓冲器并驱动GT实例的GTREFCLK0，GTNORTHREFCLK0引脚，这些引脚位于相同的时钟区域X0Y3中。我认为你需要使用GTREFCLK0，GTREFCLK1引脚。请检查 ...
回答了问题 2020-4-17 07:40

RC-STAT1未完全路由

naiztycheng

Hi@kannan.govindasamy 你能在这里上传_routed.dcp文件吗？谢谢，迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题张贴。如果某人的帖 ...

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