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[经验]

BUFG BUFG BUFGP BUFGDS 等含义以及使用

2014-11-24 17:58:10

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BUFG BUFG BUFGP BUFGDS 等含义以及使用

目前，大型设计一般推荐使用同步时序电路。同步时序电路基于时钟触发沿设计，对时
钟的周期、占空比、延时和抖动提出了更高的要求。为了满足同步时序设计的要求，一般在
FPGA 设计中采用全局时钟资源驱动设计的主时钟，以达到最低的时钟抖动和延迟。 FPGA
全局时钟资源一般使用全铜层工艺实现，并设计了专用时钟缓冲与驱动结构，从而使全局时
钟到达芯片内部的所有可配置单元(CLB)、I/O 单元(IOB)和选择性块 RAM(Block Select RAM)
的时延和抖动都为最小。为了适应复杂设计的需要，Xilinx 的 FPGA 中集成的专用时钟资源
与数字延迟锁相环(DLL)的数目不断增加，最新的 Virtex II 器件最多可以提供 16 个全局时
钟输入端口和 8 个数字时钟管理模块(DCM)。

BUFG,IBUFG,BUFGP,IBUFGDS.pdf

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5 条评论

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南盗 2015-5-2 18:07:20

看看，谢谢分享。

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胡小东 2015-5-1 16:53:33

呵呵呵，下下学学，

赞回复

duanhanhan 2014-12-4 16:55:05

好东西。
以前一直在时钟这卡住了。

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徐自耕 2014-12-3 01:15:17

学习新知识，不错的文档

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Elecfans管家 2014-11-28 15:37:44

好资料感谢分享！

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