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MODELSIM仿真提示already declared in this scope

29082 仿真

问答对人有帮助，内容完整，我也想知道答案 0 写了个程序里面调用了几个模块，quartus11.0编译时没有报错，但在modelsim仿真时提示一些信号already declared in this scope ，看了下程序，这些信号是子模块的一些输入输出信号，但在主程序中没有重复定义啊，只是对其做了必要的变量申明而已。希望能帮忙看下。 0
2013-5-9 18:49:21　　评论淘帖0 邀请回答您可以邀请以下用户，快速回答问题 × 刘英该类别下有 31 个回答。邀请回答 chenbingjy 该类别下有 27 个回答。邀请回答 yoonssica 该类别下有 22 个回答。邀请回答 houxiaoxiao 该类别下有 17 个回答。邀请回答小萃米该类别下有 16 个回答。邀请回答小工兵该类别下有 16 个回答。邀请回答 Elecfans管家该类别下有 15 个回答。邀请回答薄迪该类别下有 14 个回答。邀请回答我爱妖妖该类别下有 14 个回答。邀请回答言尽于此33 该类别下有 14 个回答。邀请回答 hxing 该类别下有 13 个回答。邀请回答那些年儿ing 该类别下有 13 个回答。邀请回答平漂流该类别下有 13 个回答。邀请回答 1653344032.827400 该类别下有 12 个回答。邀请回答小麦地该类别下有 12 个回答。邀请回答科比如我该类别下有 12 个回答。邀请回答倪love 该类别下有 12 个回答。邀请回答 xiekaboy 该类别下有 12 个回答。邀请回答黄月明该类别下有 11 个回答。邀请回答 tutu1583 该类别下有 11 个回答。邀请回答举报 xxh101 相关推荐 • ** Error: ddr3_model_parameters.vh(2968): (vlog-2155) Global declarations are illegal in Verilog 2001 syntax. 3621 • Modelsim 仿真出错 “Module 'IBUFG' is not defined” 12757 • CPLD仿真时提示path路径问题 1728 • Modelsim 仿真问题 “unisim” Does not exist 12602 • 有关夏宇闻的RISC_CPU设计遇到的问题 4709 • Quartus16波形仿真提示缺少ModelSim文件 4061 • watch提示out of scope是怎么回事？ 6379 • Modelsim仿真出错 8790 • 使用modelsim10.1编译xilinx ddr3_model_parameters_c3.vh出问题 10077 • 请问modelsim仿真出现如下问题怎么解决？ 6161 5个回答

答案对人有帮助，有参考价值 0 我也遇到同样的问题，没办法，刚好那几个文件在顶层没有调用，在脚本里把它们屏蔽掉，就没有报错了，我也等待有高手能解决这个问题。。等待中

2013-5-18 10:53:13 评论举报 506956656

刚刚碰到一个这样的问题，我是在定义这个信号前其它模块接口信号中调用了这个信号，modelsim仿真报错，通过把信号定义挪到调用模块前面问题解决，不知道和楼上的情况是否一样

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刘崇庆	+ 1	ok

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2013-5-29 14:01:33 评论

答案对人有帮助，有参考价值 0 谢谢楼上了，我的问题解决了……

2013-7-15 13:06:09 评论举报李哲哲

答案对人有帮助，有参考价值 0 506956656 发表于 2013-5-18 10:53 我也遇到同样的问题，没办法，刚好那几个文件在顶层没有调用，在脚本里把它们屏蔽掉，就没有报错了，我也等 ... 端口被重复定义

2013-9-14 21:30:45 评论举报而你却走了

答案对人有帮助，有参考价值 0 @fcy215 完美解决问题，可能是modelsim有要求，在块里边出现之前，必须先做声明。

2013-11-12 08:59:28 评论举报冯

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