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2个回答
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您好,
在DAC GUI中,需要禁用PLL模式并重新配置DAC。这将使LMK生成正确的FPGA参考时钟。你看到的不是错误,只是一条信息。 您似乎还使用了无效的设置。该部件不能使用采样时钟为6144MHz的TSW14J56EVM的120M数据速率。这将需要51.2的插值率,这是不可选的。请发送DAC GUI Quick start tab的屏幕截图,以便可以更好地帮助您解决此问题 |
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在TSW14J56板子与DAC38RF80EVM联调的过程中,如果改变6144MHz的外部时钟导致无法调试出波形,可能是由于JESD204B接口的参考时钟(Ref Clock)没有正确配置。JESD204B接口需要一个精确的参考时钟来同步数据传输,如果参考时钟频率发生变化,可能需要重新配置。
以下是一些可能的解决方案: 1. **检查硬件连接**: 确保所有硬件连接正确,包括时钟信号线和电源线。 2. **检查时钟源**: 确认外部时钟源是否稳定,并且频率准确。 3. **软件配置**: 在软件中查找JESD204B接口的配置选项。通常,这些配置选项可以在设备的配置文件或者控制软件中找到。你需要找到与JESD204B相关的设置,并调整参考时钟频率以匹配新的外部时钟频率。 4. **查看文档**: 仔细阅读TSW14J56和DAC38RF80EVM的硬件手册和软件API文档,了解如何配置JESD204B接口的参考时钟。 5. **固件更新**: 如果软件中没有直接的配置选项,可能需要更新固件或者使用特定的命令来调整参考时钟。 6. **技术支持**: 如果上述步骤都无法解决问题,建议联系硬件供应商的技术支持,他们可能需要提供更具体的指导或者固件更新。 7. **错误代码分析**: 根据软件报错信息,分析可能的原因。错误代码通常会提供关于问题所在的线索,比如时钟配置错误、硬件故障等。 8. **调试工具**: 使用调试工具(如示波器)来检查时钟信号和数据信号,确保它们在频率变化后仍然同步。 请根据你的具体情况,逐一排查上述可能的问题点,并尝试相应的解决方案。如果需要更详细的技术支持,建议提供更多的错误信息和配置细节。 |
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