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根据您提供的信息,您正在使用ADC12DJ3200 FPGA和LMK04828ADC PLL,采样率为5GSPS,sysref为3.90625MHz,模式为脉冲模式,一次发送8个脉冲。您已经配置了FPGA的JESD204B接收核,但是没有测量到204B接收核发送给发送核的SYNC信号,导致204b链路建立无法进行。
以下是一些建议和可能的解决方案: 1. 检查硬件连接:确保所有硬件连接正确,包括ADC、PLL、FPGA和示波器/频谱仪。检查是否有任何接触不良或损坏的连接。 2. 检查FPGA配置:确保FPGA配置正确,包括JESD204B接收核的配置。检查配置文件是否正确,以及是否正确加载到FPGA中。 3. 检查时钟和同步信号:确保时钟和同步信号正确生成和传输。检查PLL的输出频率和相位是否正确,以及sysref信号是否正确生成和传输。 4. 检查FPGA代码:检查FPGA代码,确保JESD204B接收核正确实现和配置。检查代码中是否有任何错误或遗漏,可能导致SYNC信号未发送。 5. 检查调试和测试工具:确保使用正确的调试和测试工具,以便正确测量和分析SYNC信号。检查示波器和频谱仪的设置是否正确,以及是否正确连接到FPGA和ADC。 6. 检查JESD204B协议:确保您了解JESD204B协议,并正确实现和配置。检查协议文档,确保您正确理解协议要求和限制。 7. 寻求技术支持:如果问题仍然存在,您可以考虑寻求技术支持。联系FPGA和ADC制造商的技术支持团队,他们可能会提供更多关于问题的详细信息和解决方案。 希望这些建议能帮助您解决问题。如果问题仍然存在,请提供更多详细信息,以便我们更好地帮助您。 |
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