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TLV320ADC3101 pll_clk 输出倍频参数跟频率是什么关系(x(RxJ.D)/P --手册上写的这个是什么意思?)我配置了pll,PLL_CLKIN输入bclk 1.536M输出pll_clk 为41M,修改了如下几个寄存器的值,pll_clk没什么变化,请问这是为什么呢? P0:0x06(6) [PLL J -VAL ] (4h) P0:0x07(7) [PLL D-VAL MSB ] (0h) P0:0x08(8) [PLL D-VAL LSB ] (0h) |
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1个回答
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您的这个问题我正在看,会在另一个类似的帖子上跟进的哈,所以这个我就暂时先关闭了。有什么问题我们在下面这个帖子上讨论:
https://e2echina.ti.com/support/audio/f/audio-forum/212280/tlv320adc3101-tlv320adc3101-pll_clk |
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