完善资料让更多小伙伴认识你,还能领取20积分哦, 立即完善>
电子发烧友论坛|
在调试NRF24L01时发现SPI读写他的寄存器失败,查找原因发现是SPI配置错误,现总结记录一下: 1.如上图,配置STM32时,需要配置的SPI相关参数
2.具体总结一下SPI_CPOL和SPI_CPHA 两个通过SPI通信的设备,需要提前协商好时钟,协商好什么时候采样。比如从设备最大支持10MHz的时钟,那么主设备SCLK频率就不能大于10MHz;然后什么时候采样呢?一般是在时钟的上升沿或下降沿时进行采样,那CPOL和CPHA就是协商具体是在上升沿还是下降沿的。 1)CPOL:Clock Polarity(时钟极性) 介绍时钟极性前,先说明什么是SCLK时钟的空闲时刻(IDLE),就是当SCLK在发送8个bit数据之前和之后的状态,与此对应的,SCLK在发送数据的时候就是正常工作的时候,有效(active)的时刻了。 现在解释时钟极性:Clock Polarity = IDLE state of SCK,也就是说,SPI的CPOL表示当SCLK空闲时,其电平是高电平1还是低电平0:当SCLK空闲时是低电平,那么CPOL=0 (高电平有效,active-high);当SCLK空闲时是高电平,那么CPOL=1(低电平有效,active-low); 2)CPHA:Clock Phase(时钟相位) 相位,对应着数据采样是在第几个边沿(edge),是第一个边沿还是第二个边沿,0对应着第一个边沿,1对应着第二个边沿。 CPHA=0,表示第一个边沿采样 对于CPOL=0,idle时为低电平,第一个边沿就是从低变到高,是上升沿,所以是上升沿采样。 对于CPOL=1,idle时为高电平,第一个边沿就是从高变到低,是下降沿,所以是下降沿采样。 CPHA=1,表示第二个边沿采样 对于CPOL=0,idle时为低电平,第二个边沿就是从高变到低,是下降沿,所以是下降沿采样。 对于CPOL=1,idle时为高电平,第二个边沿就是从低变到高,是上升沿,所以是上升沿采样。 (注:采样 = sample = read = latch = capture strobe) 举例1:nrf24l01的SPI时序图如下,看图可知SCK空闲时为低电平,所以 CPOL=0,在第一个边沿时采样比较合适所以 CPHA=0 举例2:W5500的SPI时序图如下,看图可知SCK空闲时有两种情况,SCK空闲为低电平时, CPOL=0,第一个边沿采样, CPHA=0;SCK空闲为高电平时, CPOL=1,第二个边沿采样, CPHA=1; |
|
|
|
|
只有小组成员才能发言,加入小组>>
调试STM32H750的FMC总线读写PSRAM遇到的问题求解?
4130 浏览 1 评论
X-NUCLEO-IHM08M1板文档中输出电流为15Arms,15Arms是怎么得出来的呢?
3221 浏览 1 评论
2747 浏览 2 评论
STM32F030F4 HSI时钟温度测试过不去是怎么回事?
2175 浏览 2 评论
ST25R3916能否对ISO15693的标签芯片进行分区域写密码?
14939 浏览 2 评论
STM32仿真器是选择ST-LINK还是选择J-LINK?各有什么优势啊?
3084浏览 4评论
stm32f4下spi+dma读取数据不对是什么原因导致的?
1892浏览 3评论
STM32F0_TIM2输出pwm2后OLED变暗或者系统重启是怎么回事?
2064浏览 3评论
1976浏览 3评论
stm32cubemx生成mdk-arm v4项目文件无法打开是什么原因导致的?
2165浏览 3评论
/9
小黑屋| 手机版| Archiver| 电子发烧友 ( 湘ICP备2023018690号 )
GMT+8, 2025-12-1 19:32 , Processed in 0.722905 second(s), Total 72, Slave 55 queries .
Powered by 电子发烧友网
© 2015 bbs.elecfans.com
关注我们的微信
下载发烧友APP
电子发烧友观察
版权所有 © 湖南华秋数字科技有限公司
电子发烧友 (电路图) 湘公网安备 43011202000918 号 电信与信息服务业务经营许可证:合字B2-20210191

淘帖
1177