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你好。
我的PCIe设备上有2个Artix FPGA（xc7a200t-fbg676），通过极光接口连接。 这个Aurora在一些PCIe插槽中常常出现故障，而在其他PCIe插槽中它不会上升。在链接断开之前，我看到一连串的SoftErrors，然后是HardError。 如果我设置近端PMA环回链路是稳定的。 由于这种奇怪的PCIe插槽依赖性，我认为时钟存在问题，因为Aurora的参考时钟是从具有ICS854104缓冲器的PCIe插槽的PCIe参考时钟（100MHz）中提取的。 然后我发现PLL0REFCLKLOST = 1。 现在我找不到原因...... 我已经检查过参考时钟是在FPGA下的过孔上呈现的（在交流耦合电容之后）。 我使用MGTREFCLK1P / N dif对。 （AA11，AB11引脚） 在我的ucf我找到了他们： NET“GTPQ0_P”LOC = AA11; NET“GTPQ0_N”LOC = AB11; IBUFDS_GTE2的GT_REFCLK转到GTPE2_COMMON / GTREFCLK1 PLL0REFCLKSEL =>“010” 而且，我明白了 PLL0LOCK = 1（不知何故） 和GTPE2_CHANNEL的TxOutClkLock = 1 和aurora_8b10b_v8_3_CLOCK_MODULE的PLL_NOT_LOCKED为0。 在没有GTREFCLK的情况下PLL是如何被锁定的，如果我在两个器件上的FPGA引脚附近的过孔上看到这个时钟，那么PLL0REFCLKLOST = 1怎么样呢？ 伊利亚 
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7个回答
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看起来你正在使用v8.3，这个版本的IP没有一些GT相关的更新需要。
请检查您是否可以使用2014.3（或）之后的IP。 -------------------------------------------------- ----------------------------别忘了回复，给予kudo并接受为解决方案--------- -------------------------------------------------- ------------------- 在原帖中查看解决方案 |
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如果它可以帮助：
常数PLL0_FBDIV_IN：整数：= 5;常数PLL0_FBDIV_45_IN：整数：= 5;常数PLL0_REFCLK_DIV_IN：整数：= 1; 这意味着PLL工作在100MHz * 5 * 5 = 2500 MHz 伊利亚 |
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我已经从MGTREFCLK中删除了交流耦合电容，看看是否有任何变化，如果真的没有参考时钟。
现在所有LOCK信号都为0，并且aurora_8b10b_v8_3_CLOCK_MODULE = 1的PLL_NOT_LOCKED。 这并不意味着MGTREFCLK存在。 为什么PLL0REFCLKLOST = 1？ 伊利亚 |
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您使用的是哪个版本的IP？
按照PG046中的说明确认您正在执行复位序列 -------------------------------------------------- ----------------------------别忘了回复，给予kudo并接受为解决方案--------- -------------------------------------------------- ------------------- |
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看起来你正在使用v8.3，这个版本的IP没有一些GT相关的更新需要。
请检查您是否可以使用2014.3（或）之后的IP。 -------------------------------------------------- ----------------------------别忘了回复，给予kudo并接受为解决方案--------- -------------------------------------------------- ------------------- |
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只有小组成员才能发言，加入小组>>
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