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我想在我的设计中读取每一行CLB FF的状态。
我似乎可以使用capture_virtex5进行异步捕获，这正是我所需要的。 我不完全确定这是如何工作的。 是否捕获了活动设计中所有FF的状态？ 我怎样才能捕获口头回读我感兴趣的FF？ 谢谢 
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4个回答
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你是对的，CAPTURE原语会将FF的当前状态注册到配置空间。
新值实际上是在INIT值在FF上的位置。 然后可以使用回读并且可以解析回读文件以及时确定该实例处的FF的状态。 Virtex-5 Config UG在回读文件以及这些组件如何对齐方面有很好的部分。 您还需要.ll文件，它是BitGen的逻辑分配文件，用于将特定组件映射到文件中的位位置。 在发出捕获脉冲之前，还应通过使用时钟使能来暂停设计。 如果织物向上运行150MHz，则捕获脉冲可以捕获设计的不同状态。 该流程有助于确定整个设计的状态。 如果需要调查小部分代码，则应使用ChipScope。 这是一个更简单的流程，允许您直接插入到所讨论的代码部分。 在设计运行时也可以监视信号，而不是在单个实例中监视。 捕获方法是一个更加手动的过程，如果由我决定，我会先查看是否可以从ChipScope中获取所需的信息，但无论哪种方式都可以正常工作。 希望这可以帮助。 在原帖中查看解决方案 |
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你是对的，CAPTURE原语会将FF的当前状态注册到配置空间。
新值实际上是在INIT值在FF上的位置。 然后可以使用回读并且可以解析回读文件以及时确定该实例处的FF的状态。 Virtex-5 Config UG在回读文件以及这些组件如何对齐方面有很好的部分。 您还需要.ll文件，它是BitGen的逻辑分配文件，用于将特定组件映射到文件中的位位置。 在发出捕获脉冲之前，还应通过使用时钟使能来暂停设计。 如果织物向上运行150MHz，则捕获脉冲可以捕获设计的不同状态。 该流程有助于确定整个设计的状态。 如果需要调查小部分代码，则应使用ChipScope。 这是一个更简单的流程，允许您直接插入到所讨论的代码部分。 在设计运行时也可以监视信号，而不是在单个实例中监视。 捕获方法是一个更加手动的过程，如果由我决定，我会先查看是否可以从ChipScope中获取所需的信息，但无论哪种方式都可以正常工作。 希望这可以帮助。 |
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我做回读后有哪些比较选择？
理想情况下，我想以随机间隔不止一次进行比较。 因此，每当我捕捉到翻牌的状态时，它就会被丢弃。 那么CAD工具会使用我从本地分配文件制作的掩码文件自动对我进行验证/比较吗？ 回读文件是否会保存到某处以供将来参考？ 后回读与比较之间的步骤不太清楚。 |
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捕获只会将FF的当前状态推入CLB中的“INIT”位置。
接下来，必须运行回读，这可以通过以下几种方式运行： 1 - JTAG使用影响，但这样做有点棘手。 该软件默认只进行验证。 要保存回读文件，您需要设置以下环境变量。 这些将创建存储impact.log文件的回读数据文件。 我喜欢在.bit和.msk文件所在的driectory中打开命令行，然后键入“impact”，工具将从那里开始并在同一目录中创建文件。 你应该只需要其中一个，但我只是包括了所有这些。 XIL_IMPACT_DUMP_BIN = TRUE; XIL_IMPACT_DUMP_READBACK_DATA = true; XIL_IMPACT_VIRTEX_DUMPBIN = true; 2 - 使用处理器和Persist设置进行SMAP 因此，一旦有了回读文件，就需要将它与.msk对齐以进行比较。 最好使用来自bitgen（.l）的.ll文件，因为它具有所有位回读的名称。 因此，通过回读和.ll，您可以看到每个位的变化。 文件对齐变得棘手，因此文件包含命令，一些文件以原始数据开头。 希望有所帮助！ |
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