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Vivado 2014.4 64位,Ubuntu 14.10,Virtualbox 8Gb RAM
我选择“工具_>创建和打包IP - >创建AXI外设”。 我选择所有默认值并运行连接自动化。 这个合成,我可以从裸机应用程序的寄存器说话。 我右键单击我的IP并选择“在IP打包器中编辑”。 我选择添加 - 创建一个源文件(multiplier.v),我实现了一些逻辑,然后修改IP来实例化并连接这个逻辑。 知识产权项目合成。 我现在转到“打包IP” - >文件组,我运行向导并确保包含新文件。 我选择Review and Package - > RePackage IP并关闭项目。 现在主项目将不再合成,它会陷入困境 [IP_Flow 19-167]无法传递一个或多个文件。 [IP_Flow 19-3505] IP生成错误:无法生成IP“design_1_myip_0_0”。 无法生成'Verilog Synthesis'输出: [IP_Flow 19-98]生成IP CORE失败。无法生成IP'design_1_myip_0_0'。 无法生成'Verilog Synthesis'输出: [BD 41-1030] IP Integrator块myip_0的生成失败 [IP_Flow 19-167]无法传递一个或多个文件。 [IP_Flow 19-3505] IP生成错误:无法生成IP“design_1_myip_0_0”。 无法生成'Verilog Synthesis'输出: [IP_Flow 19-98]生成IP CORE失败。无法生成IP'design_1_myip_0_0'。 无法生成'Verilog Synthesis'输出: [BD 41-1030] IP Integrator块myip_0的生成失败 [IP_Flow 19-663]无法复制文件'/home/dev/ip_repo/myip_1.0/myip_v1_0_project/myip_v1_0_project.srcs/sources_1/new/multiplier.v',它不存在。 [IP_Flow 19-663]无法复制文件'/home/dev/ip_repo/myip_1.0/myip_v1_0_project/myip_v1_0_project.srcs/sources_1/new/multiplier.v',它不存在。 同时在〜/ ip_repo下检查那里没有multiplier.v文件。 如何在打包IP时确保包含所有文件? 看起来IP指的是位于IP Packager创建的临时项目中的multiplier.v文件,但此后已被删除。 如何使其导出实际文件,然后通过正确的路径引用它? |
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8个回答
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你好,
从警告消息中,您似乎在创建IP时缺少multiplier.v文件。 确保在打包IP时在文件组中添加multiplier.v文件。 见下面的快照: 谢谢, 维奈 -------------------------------------------------- ------------------------------------------您是否尝试在Google中输入问题? ? 如果没有,你应该在发布之前。 此外,MARK这是一个答案,以防它有助于解决您的查询/问题。给予帮助您找到解决方案的帖子。 |
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感谢您的回复。
我已经检查了IP打包器中的所有框,以确保包含文件。 它仍然无法正常工作,该文件永远存在于IP Packager在编辑时创建的临时项目文件夹中。 component.xml包含: myip_v1_0_project / myip_v1_0_project.srcs / sources_1 /新/ MULT iplier.v 所以它指的是临时项目中的路径,这当然不会随着项目被删除而工作(默认情况下)。 如果我在导出IP后选择不删除临时IP包装程序项目,它似乎工作得更好一些。 由于项目未被删除,以上参考文献有效。 但相反,我会在一段时间后得到以下内容(它运行时间比以前长) [Synth 8-439]找不到模块'myip_v1_0'[“/ home /dev/project_5/project_5.srcs/sources_1/bd/design_1/ip/design_1_myip_0_0/synth/design_1_myip_0_0.v":126] [Synth 8-285]合成模块'design_1_myip_0_0'失败[“/home/dev/project_5/project_5.srcs/sources_1/bd/design_1/ip/design_1_myip_0_0/synth/design_1_myip_0_0.v":56] [Synth 8-285]合成模块'design_1'失败[“/ home /dev/project_5/project_5.srcs/sources_1/bd/design_1/hdl/design_1.v":12] [Synth 8-285]合成模块'design_wrapper'失败[“/ home /dev/project_5/project_5.srcs/sources_1/new/design_wrapper.v":12] [Common 17-69]命令失败:合成失败 - 请参阅控制台或运行日志文件以获取详细信息 无论如何,考虑到文件从未正确包含在ip中,我必须做错事。 |
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嗨,将乘数.xci文件添加到ip packager“file froups”部分中的“合成组”和“模拟组”。右键单击“文件组”部分中的任何文件,然后单击“添加文件”以添加xci
file.Thanks,迪皮卡。 谢谢,迪皮卡.---------------------------------------------- ---------------------------------------------- Google之前的问题 张贴。 如果某人的帖子回答了您的问题,请将帖子标记为“接受为解决方案”。 如果你看到一个特别好的和信息丰富的帖子,考虑给它Kudos(左边的明星) |
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谢谢,遗憾的是IP项目中没有这样的文件。
如果我直接在IP包的hdl /目录中创建multiplier.v文件,它会运行并在component.xml中引用相对路径。 无论如何,似乎很奇怪我不能简单地选择将它包含在包装中。 仍然,合成停止在“modyule my_v1_0 not found”。 我是否需要做任何进一步的实际包含来自ip_repo的东西? 正如我可以看到IP目录中的IP,我将不得不假设已经包含了回购? |
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我现在设法通过创建一个新的托管IP位置并从那里创建IP而不是从我的主项目来合成自定义IP。
我对此很满意。 虽然我可以通过直接在hdl /中创建文件或者将IP Packager临时项目保留在磁盘上来解决这个问题,但我仍然对文件没有包含IP包装的原因感到困惑。 这似乎并不理想,所以我非常感谢能够如何做到这一点的正确解决方案。 |
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我希望复制和编辑AXI BRAM控制器。
1)复制现有IP以使我自己的项目本地修改版本的正确方法是什么。 2)我想添加一些输出来驱动性能监视器IP ...我很难让IP打包器识别IP的新输出,即使在更改编译顺序时......还有其他的尝试吗? 谢谢鲍勃 |
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我想修改XILINX IP的BRAM控制器......带出一些输出以支持性能监控......我无法添加新的输出并想复制,重新命名然后退出...怎么做
我这样做? ...而不是创建新的用户IP? 谢谢,鲍勃。 |
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嗨@ bdixon007,
如果您需要快速响应,那么您最好创建一个新帖子,而不是加入另一个消息的结尾。 axi bram控制器包含在C: Xilinx Vivado 2017.2 data ip xilinx axi_bram_ctrl_v4_0中,您可以在这里查看HDL并找到IP的.xml文件。 以这种方式修改IP不是受支持的流程。 正确的方法是创建和打包一个新的IP.Best RegardsAidan -------------------------------------------------- -------------------------------------------------- --------------请将答案标记为“接受为解决方案”,如果这回答了您的问题,请给予您认为有用的帖子,并可以帮助其他用户------- -------------------------------------------------- -------------------------------------------------- ------- |
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只有小组成员才能发言,加入小组>>
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