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电子发烧友论坛|
大家好，我需要你的帮助。
我使用acctuellement XSG来实现DS5203中的系统。 当我在执行以下错误消息之前运行timing Analysis时： “时钟包装输出丢失或损坏解决方案” 有谁知道如何解决这个问题？ 
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5个回答
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嗨，
你正在面对跟随错误消息？ 硬件协同仿真编译失败。 在设计中找不到时钟包装器实例 如果是，您使用的是哪个版本的ISE？ 这是ISE 13.2中的已知问题，并在ISE 14.1及更高版本中得到修复。 谢谢， Shreyas -------------------------------------------------- --------------------------------------------尝试搜索你的答案 在发布新帖子之前在论坛或xilinx用户指南中发出问题。请注意 - 如果提供的信息解决了您的问题，请将答案标记为“接受为解决方案”。给予您认为有用的帖子给予荣誉（右边提供的星号） 并回复.---------------------------------------------- ------------------------------------------------ |
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您没有使用DS5203 FPGA，因为它不存在，但我认为您使用的是dSPACE的DS5203板，其上有一个Virtex-5 FPGA。
请发布工具报告的整个错误消息。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com |
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嗨，
谢谢你的重播， 错误信息是： Xilinx系统生成器的构建出错。 时钟包装器输出丢失或损坏：E： test_perso ADC_Gestion_xilinx_simulation _RTI timing ADC_cw.vhd ?? |
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嗨！
我面临同样的问题！ 但似乎我有一个解决方案：在simulink中尝试给你的FPGA子系统另一个名字。 使用一些非常简单的名称。 请勿使用符号化（除了下划线） - 仅限字母。 重命名FPGA子系统后，转到主模型中的处理器设置模块，然后从列表中选择新的重命名的FPGA子系统。 重新启动Matlab并再试一次。 也许这个解决方案对你也有帮助。 祝你好运， 亚历克斯。 |
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