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你好
我用cy8ckit-042-blei要转换模拟输入的数字但我找不到这样做正确的组件。所以我的问题是在采取一种模拟和数字的同时,我的包销不需要做任何转换或是存在的,我应该用这样的一个组成部分。 我试图建立该项目的想法是计数脉冲。一份文件被附加在这里 谢谢 阿里 Graco。Cysnz.zip 2.2兆字节 |
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11个回答
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嗨,鲍伯, 我确实打开了一个案例,但找到了一个解决方案从柏树知识库文章: ADC误差和补偿这些误差的技术: 增益校准:为了补偿增益误差,向ADC施加已知电压。测量ADC计数。计算输入电压/ ADC计数的比率。将此值存储为比例因子。在正常测量期间,通过比例因子乘以ADC计数,以获得增益补偿值。 我所做的是得到一个已知的良好的3.3V轨ADC计数,并计算这个输入电压/ ADC计数的比率,并以此作为缩放因子来计算从ADC计数的MV。我不想处理浮点,因此: 比例尺=(3300 MV/ADCJCNT)* 1000 MV Read=(ADCJCNT *比例)/ 1000 我的案件比例因子为58。 这个比例系数适用于所有电压轨: 读取电压轨。请等待…P5P0VYRAM: 5026 mV(ADC计数=65880)P3P3VYRAM: 3305 mV(ADC计数=56994)2P5VYRAM: 2483 MV(ADC计数=42825)P1P6VYRANE:1658 mV(ADC计数=28594)P0P8VYRANE:830 mV(ADC计数=14311)PSYVRYRADY: 1008 mV(ADC计数=17380) 我在这里发布我的项目文件,仅供参考,以防万一有人碰到这个问题。 工作空间:CY8C3666 AXI040Y0.ZIP 2.1兆字节 |
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你确定你的分压器是正确的吗?你的电压计算与除法器匹配吗?当所有其他电压都正常时,似乎没有一个普遍的错误。
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HI HLI,这些电压读数已被验证的DVM。我在CY8CITK-1001开发板上的端口PIN头上进行了测量。 |
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嗨,鲍伯,是的,我用DVM在CY8CKIT-1001端口引脚头的正确引脚上多次测量。我也连接导线在面包板上的3.3V,测量和验证3.3v在导线的另一端插入不同的前端口(P2 [ 7 ]),然后添加到一个新的地址复用器,编译程序和运行通道,再通过调试和阅读的价值是相同的:
读取电压轨。请等待…p5p0v_rail:5026 mV(ADC数= 65881)p3p3v_rail:4350 mV(ADC数= 57025)p2p5v_rail:2657 mV(ADC数= 69668)p1p6v_rail:1667 mV(ADC数= 53347)p0p8v_rail:839 mV(ADC数= 53733)p3p3v2_rail:4351 mV(ADC数= 57031) |
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当将Buffer Mode设置为“旁路缓冲区”时,ADCJ-DeligyGETReultT32()返回的ADC计数甚至更高:
读取电压轨。请等待…P5P0VYRAM: 5544 mV(ADC计数=72672)P3P3VYRAM: 4253 mV(ADC计数=55750)2P5VYRAM: 2657 mV(ADC计数=69668)P1P6VYRANE:1666 mV(ADC计数=53336)P0P8VYRANE:839 mV(ADC计数=53707)P3P3V2Y轨:4253 mV(ADC计数=55751) |
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嗨,鲍伯,我的问题是为什么我需要为每个电压轨使用不同的配置?我应该能够使用CFG1与输入范围设置为“VSSA到VDDA”,这是从GND到5V,以获得ADC转换计数为每5V,3.3V,2.5V,1.6V,和0.8V轨。但它似乎并没有这样工作。引用的设置只能设置为“内部VDDA / 4”,因为我没有H/W设置,“内部VDDA / 4绕过P0.3”或“内部VDDA / 4旁路P3.2”。我还能设置什么使CFG1在Vssa和Vdda(0到5V)之间正确地处理所有的电压电平?
谢谢, 栾 |
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当我将Buffer Mode设置为“旁路缓冲区”时,AdcDeligyGETReultT32()甚至更高:这就是我所期望的。
接下来,我建议您将ADC开始等待停止GET结果更改为单个ADCXRead 32()调用。参见ADC数据表。 鲍勃 |
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jml2016 发表于 2019-9-23 21:06 我尝试了ADCJ-DeligyRead 32()调用,仍然有相同的结果! |
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