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我使用COREGEN在我的SPARTAN 6 45T FGG484 -3设备中生成3G-SDI GTP。
实现GTP PLL锁定,并且userclk频率正确。 txbufstatus [1:0]是2'b10。 我使用{10'h3FF,10'h0}的常数DIN [19:0]来降低TXN和TXP频率。 我想我可以在我的范围内得到一个line_rate / 20平方波形。 但是当我按范围测量TXN和TXP时,没有检测到信号。 PCB连接是正确的,因为该板之前用作SATA PHY。 我该如何调试这个问题? 以上来自于谷歌翻译 以下为原文 I use COREGEN to generate a 3G-SDI GTP in my SPARTAN 6 45T FGG484 -3 device. GTP PLL lock is achieved, and userclk frequency is correct. txbufstatus[1:0] is 2'b10. I use a constant DIN[19:0] of {10'h3FF,10'h0} to reduce the TXN and TXP frequency. I thought I could get a line_rate / 20 square waveform in my scope. But when i measure the TXN and TXP by scope, there is no signal detected. the PCB connection is correct because this board is used as a SATA PHY before. How can I debug this problem ? |
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1个回答
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TXBUFSTATUS表示缓冲区有溢出/下溢情况。如何关于userclk2输入?
你发现GTPRESETDONE断言HIGH?你能找到成功的设计吗? 你在模拟中找到了预期的输出吗? -------------------------------------------------- ----------------------------别忘了回复,给予kudo并接受为解决方案--------- -------------------------------------------------- ------------------- 以上来自于谷歌翻译 以下为原文 TXBUFSTATUS denotes the buffer has overflow/underflow condition.. How about userclk2 input? Do you find GTPRESETDONE asserted HIGH? could you find the design simulate successfully? Do you find the expected output in simulation?------------------------------------------------------------------------------ Don't forget to reply, give kudo and accept as solution ------------------------------------------------------------------------------ |
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只有小组成员才能发言,加入小组>>
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