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PSoC 3 KIT-030数据表建议不要使用VDDD高于VDDA…原因何在？
当做。 以上来自于百度翻译 以下为原文 The PSoC 3 kit-030 datasheet recommends not to use a VDDD higher than VDDA..... What is the reason for that? Regards. 
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7个回答
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数字电源电压可以与模拟电源电压一样高。从PSoC3架构引用：TRM:VDDA必须大于或等于PSOC 3中的所有其他电源引脚（VDDD，VDDIOS）。该电源条件对于器件内部模拟开关的正确开/关条件以及在多个电源电压域之间的信号转换时实现内部电平切换逻辑是必需的。（第136页）
以上来自于百度翻译 以下为原文 The digital supply voltage can be as high as the analog supply voltage. To cite from the PSoC3 Architecture TRM: Vdda must be greater than or equal to all other power supply pins (Vddd, Vddios) in PSoC 3. This power supply condition is required for the proper ON/OFF condition of the analog switches inside the device, and also for the implementation of the internal level switching logic when signals transition between multiple supply voltage domains. (page 136) |
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在最基本的层次上，模拟交换和路由控制是基础。
CMOS模拟开关特性，以及器件几何结构。 参考文献 COM/Labaly/ApdidiLogue/GraciSe/31-3/ASK.HTML 有一些技术，比如门驱动器Boost转换器，可以达到高电平。 开关栅极驱动的低核心电压，但总是权衡 招致。Boost意味着更多的数字噪声耦合 通过CGD，CGS在交换机中。 问候，Dana。 以上来自于百度翻译 以下为原文 At its most basic level analog switching and routing govern the basic CMOS analog switch characteristics, as well as device geometry. Reference - www.analog.com/library/analogdialogue/archives/31-3/ask.html There are techniques, like gate drive boost converters, to get high switch gate drive out of low core voltages, but as always tradeoffs are incurred. Boost generaly implies more digital noise coupled thru Cgd, Cgs in the switch. Regards, Dana. |
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这一要求是因为您有数字逻辑控制模拟组件（但反之亦然）。想想，例如，由控制寄存器控制的模拟多路复用器。如果数字电压高于模拟电压，就好像是坏了，就像对输入施加太高的电压一样。
以上来自于百度翻译 以下为原文 This requirements is because you have digital logic controlling analog components (but not vice versa). Think about, e.g., the analog muxes controlled by a control register. It would be bad if the digital voltage would be higher than then analog on - its like applying a too high voltage to an input. |
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模拟传输门的数字控制V受到门Ox的限制。
非隔离井芯片设计中的击穿和寄生二极管开启。 此外，VGS希望尽可能高，在这些约束条件下， 以获得最大接通，从而导致更高的开关速度和驱动， 因此功率较低。实现欧姆开关性能的最小RDSON 是最重要的。 所有这些目标都是为了实现比传输门中的模拟更高的VG。 在可能的情况下。受噪声馈电等影响。 权衡，总是权衡。 问候，Dana。 以上来自于百度翻译 以下为原文 The digital control V of an analog transmission gate is limited by gate ox breakdown and parasitic diode turn on in non isolated well chip designs. Additionally Vgs wants to be as high as possible, within those constraints, to obtain max turn on, thereby resulting in higher switching speed and drive, hence lower power. And to achieve min Rdson where ohmic switch performance is paramount. The goal of all this is to achieve higher Vg than analog in the transmission gate where possible. Subject to noise feedthru, etc.. Tradeoffs, always tradeoffs. Regards, Dana. |
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奥利特…所以原因深入到CMOS开关特性……无论如何，我得到它…谢谢解释这个。
然而，假设某个应用要求数字银行工作在比模拟银行高的电压下，在PSoC这种情况下有什么办法吗？ 当做。 以上来自于百度翻译 以下为原文 olryt....so the reason goes deep into the CMOS switching features.......Anyways, I get it...Thanks for explaning this. However, assuming that a certain application requires the digital bank to work at a voltage higher than that of the analog bank...can anything be done in PSoC for this particular case? Regards. |
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你可以在较低的电压下运行所有的东西，并使用电平移位器来处理数字信号。或者你运行在更高电压上的任何东西，在模拟输入上使用分压器（如果它们由于某种原因而需要），并将输出限制在你想要的电压上。事实上，我看不出这种情况的必要性——为什么我们要比数字电路更低的电压运行模拟部分？
以上来自于百度翻译 以下为原文 You can either run everything on the lower voltage and use level shifter for the digital signals. Or you run everything on the higher voltage, use voltage dividers on the analog inputs (if they are needed for some reason) and limit the outputs to the voltage you want. Actually I don't see any need for that scenario - what would be a reason tu run the analog section at a lower voltage than the digital one? |
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Evayi不需要更高的VDDD…BUTI只是假设它[你知道，HutoTale]：以防万一我们需要…！！！！！！
当做。 以上来自于百度翻译 以下为原文 Even I dont need a higher VDDD...but I was just assuming it [you know, hptothetically ]: just in case we need to...!!!!! Regards. |
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加入小组2105 浏览 1 评论
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