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大家好
我是FPGA的新手,我真的很困惑我应该对两个不同的P& SMA用户时钟的N个引脚,存在于SP605 eval中。 板。 我可以应用0到3.3v之间的时钟吗? 它安全与否? Moneer 以上来自于谷歌翻译 以下为原文 Hi every body I'm new to FPGA and I'm realy confused about how much voltage level should I apply to the two differnet P & N pins of the SMA user clock which exist in SP605 eval. board. can I apply a clock between 0 and 3.3v? is it safe or not? Moneer |
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1个回答
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是,
每个IO引脚都有自己的驱动器,单端接收器,DFF等。 成对的IO引脚(P,N)有差分驱动器和接收器,没有端接,有线, Austin Lesea主要工程师Xilinx San Jose 以上来自于谷歌翻译 以下为原文 Yes, Each IO pin has its own driver, single-ended recceiver, DFF, etc. Pairs of IO pins (P,N) have the differential drivers and receivers with ans without termination, as wired, Austin Lesea Principal Engineer Xilinx San Jose |
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