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电子发烧友论坛|
大家好 ：
我想知道ML605 FPGA板上是否有任何输出时钟（单端或差分）availbale？ 我想开发一张FMC daught卡，而我很惊讶地发现没有时钟源可用。 在FMC界面。 如果没有输出时钟可用。 在整个董事会，我必须自己设计一张时钟。 但我不确定单端3.3V时钟（输出类型：CMOS）是否可以连接到H4：CLK0_M2C_P @ FMC_LPC连接器或G2：CLK1_M2C_P @ FMC_LPC连接器，因为它们的存储体处于2.5V电压电平？ 此外，这两个引脚的前缀MRCC和GC不同。 我不知道从MRCC得到的时钟信号是否驱动所有FPGA逻辑单元，就像GC那样（或者是???） 谢谢你的关注和祝福！ 
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4个回答
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FMC v1.1规范的时钟源自FMC模块和CC基板。
由于每个FMC模块都有一个可以各种速度运行的自定义前端，因此可提供最大的系统灵活性。 要求CC基板支持任何可能的频率将是一个繁重的要求。 IO总线，LA，HA，HB没有方向性。 您可以使用这些引脚将时钟从FPGA传递到FMC，但是如果选择此系统架构，则FMC模块将限制为可以提供所需时钟的CC工作。 此外，这些IO总线不得超过VADJ电压电平。 在SP601，SP605和ML605上，这个值为2.5V，与3.3V LVCMOS不兼容。 MRCC和SRCC是Virtex-6中使用的新IO类型定义。 MRCC表示多区域时钟能力输入，SRCC表示单区域时钟能力输入，此分类是指通过专用资源连接到高性能总线的IOB寄存器的能力。 其中每个都能够连接到全局时钟资源，如BUFG和MMCM。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com 在原帖中查看解决方案 |
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FMC v1.1规范的时钟源自FMC模块和CC基板。
由于每个FMC模块都有一个可以各种速度运行的自定义前端，因此可提供最大的系统灵活性。 要求CC基板支持任何可能的频率将是一个繁重的要求。 IO总线，LA，HA，HB没有方向性。 您可以使用这些引脚将时钟从FPGA传递到FMC，但是如果选择此系统架构，则FMC模块将限制为可以提供所需时钟的CC工作。 此外，这些IO总线不得超过VADJ电压电平。 在SP601，SP605和ML605上，这个值为2.5V，与3.3V LVCMOS不兼容。 MRCC和SRCC是Virtex-6中使用的新IO类型定义。 MRCC表示多区域时钟能力输入，SRCC表示单区域时钟能力输入，此分类是指通过专用资源连接到高性能总线的IOB寄存器的能力。 其中每个都能够连接到全局时钟资源，如BUFG和MMCM。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com |
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谢谢你的快速回复:)如果我决定用它作为FMC daught卡的时钟源，你能告诉我如何约束垫吗？
另外我想在设计卡上设计一个3.3V时钟（输出类型：LVDS）。它的输出可以连接到FMC_LPC连接器上的CLK0_M2C_P和CLK0_M2C_N引脚，因为这些引脚位于2.5V电压组？ |
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LVDS标准具有定义的共模电压（1.25V）和差分摆幅（600mV）。
无论用于输出缓冲器的VCC是1.8V，2.5V还是3.3V，它都必须满足称为LVDS的标准。 ------您是否尝试在Google中输入问题？ 如果没有，你应该在发布之前。太多结果？ 尝试添加网站：www.xilinx.com |
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