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嗨,所有的,我想使用FLAGA~D作为空/满标志在奴隶FIFO模式,即,外部FPGA作为主人。根据数据表,SLCS必须设置为低以选择68013,这是否意味着FLAGD不可能被用作空/满标志?对此有何建议?谢谢
以上来自于百度翻译 以下为原文 Hi all, I'd like to use flaga~d as empty/full flag in slave FIFO mode, i.e, external FPGA acts as master. according to data sheet, slcs# has to be set low to select 68013, does this mean the flagd is impossible to be used as empty/full flag? any suggestion on this? Thanks |
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7个回答
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你好,
不,不是那样的。#类和flagd是门两种功能。7针。pa.7可以作为GPIO,或#或flagd类,可以配置使用portacfg登记。 PA.7作为FLAGD,如果PoTaFFG。7=1 PA.7作为SLCS,如果PosiAcfg。6=1,IFCONTION 1:0=11。 如果portacfg。7和portcfg。6 = 0,然后pa.7作为GPIO。 因此,使用pa.7作为flagd,保持portacfg。7 = -1;portacfg六= 0。 重新定义 加亚特里 以上来自于百度翻译 以下为原文 Hi, No it is not that way. SLCS# and FLAGD are two alternative functions of PORTA.7 pin. PA.7 can either act as GPIO, or SLCS# or FLAGD, which can be configured using PORTACFG register. PA.7 acts as FLAGD, if PORTACFG.7 = 1 PA.7 acts as SLCS# if PORTACFG.6 =1 and IFCONFIG1:0 =11 if both PORTACFG.7 and PORTCFG.6 = 0, then PA.7 acts as GPIO. So, for using the PA.7 as FLAGD, keep PORTACFG.7 = 1; PORTACFG.6 = 0. Regrds, Gayathri |
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嗨,Gayathri,
感谢您的快速回复。 是的,我明白你说的话。 但根据数据表,如果类#不是断言,芯片更是无法选择的,和# SLWR # SLRD,#等无效,野莓。 简要说明我的申请, 我想用标志~ D为固定空满标志为端点的2、4、6、8和掌握可以监控这些旗子仲裁时应发送/接收数据从相应的终点/。但根据数据信息,我似乎没有办法访问所有4旗同时保持68013选。是这样吗? 有没有为我实现其他的选择吗? 谢谢, 尼克。 以上来自于百度翻译 以下为原文 Hi Gayathri, thanks a lot for your quick reply. Yes, I see what you said. but according to the data sheet, if SLCS# is not asserted, the chip is even not selected, and SLRD#, SLWR#, SLOE# etc is invalid. a brief description of my application, I want to use flaga~d as the fixed full/empty flag for endpoint 2,4,6,8, and master could monitor these flags to arbit when should send/receive data to/from the corresponding endpoint. but according to the data info, it seems I have no way to access all the 4 flags while keep 68013 selected. is this the case? is there any other option for my implementation? Thanks, Nick. |
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嗨,Nick,
只有当PA.7被配置为SLCS时,才需要断言SLC**。在所有其他情况下,您可以忽略SLCs*,并且可以使用该PIN作为标志。D PrimeD D优先于SLCs*,即使在PuraCfg 6和PoTaCfg7都被配置时也是如此。 您可以参考下面的应用说明,说明FPGA如何在FX2LP的从FIFO接口上执行读写操作。 HTTP://www. CyPress?COM/?RID=43046 如果您有任何与本申请书相关的问题,请告诉我。 谢谢, Sai Krishna。 以上来自于百度翻译 以下为原文 Hi Nick, You need to assert SLCS# only when PA.7 is configured to function as SLCS#. In all other cases, you can ignore SLCS# and you can use that pin as FLAG D. FLAG D takes the priority over SLCS# even when both PORTACFG.6 and PORTACFG.7 are configured. You can refer to the following application note that shows how an FPGA can perform read and write operations on the Slave FIFO interface of FX2LP. http://www.cypress.com/?rID=43046 Please let me know if you have any questions related to this application note. Thanks, Sai Krishna. |
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你好,
因此,简而言之,当PaTaCfg 7=1时,PA.7不作为芯片选择引脚(SLC*)。 当做, 加亚特里 以上来自于百度翻译 以下为原文 Hi, So ,in short, PA.7 does not act as a chip select pin (SLCS#) when PORTACFG.7 = 1. Regards, Gayathri |
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非常感谢Gayathri:
因此,当PA.7不作为芯片选择(SLCs*)时,SLRDγ,SLWRγ,SLLEα也可以没有任何问题地工作。即,在这种情况下选择芯片? 最好的问候, 尼克 以上来自于百度翻译 以下为原文 Many thanks to Gayathri:) so when PA.7 doesn't act as a chip select(slcs#), slrd#, slwr#, sloe# could also work without any issue? i.e, the chip is selected in this case? Best regards, Nick |
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似乎链接应用给出了答案。
再次感谢 尼克 以上来自于百度翻译 以下为原文 it seems the link application gives the answer. Thanks again Nick |
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是的。。。你的理解是正确的。所以当pa.7不作为SLC #,其他奴隶一样# SLWR信号SLRD,#等将没有任何问题,好的工作。
当做, 加亚特里 以上来自于百度翻译 以下为原文 Yep... your understanding is correct. So when PA.7 does not act as SLC#, other slave signals like SLRD#, SLWR# etc will work fine without any issues. Regards, Gayathri |
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只有小组成员才能发言,加入小组>>
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