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5 个讨论
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zbb9612 发表于 2018-7-24 06:35 我现在就是在仿真状态下啊，SYSCLK2: 1/x-rate clock for CorePac (emulation). 意思是在仿真状态下，core使用的clock为sysclk2，如果是烧写之后正式运行，就使用sysclk1，不知道我这样的理解对不对 |
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邱艳yyxx 发表于 2018-7-24 06:53 SYSCLK2是给DSP内部Emulation module提供时钟源，并不是说你通过ccs仿真器调试这个环境，core clock不随着调试环境变更时钟的！ |
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zbb9612 发表于 2018-7-24 07:00 谢谢，是不是说无论是不是仿真状态，core用的工作时钟都是sysclk1，并且只受PLLM调节。SYSCLK2只是给emulation module 提供时钟的。 |
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邱艳yyxx 发表于 2018-7-24 07:08 对 |
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