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张奥

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他的提问 45 他的回答 407 去回答

回答了问题 2020-7-19 16:32

请问Vertex 7 FPGA的最大DSP级联限制是多少？

A493481244

嗨，请参考下面UG的-52页，它说 “路径中级联的最大数量仅受芯片中一列中DSP48E1片的总数限制” http://www.xilinx.com/support/documentation/user_guides/ug479_7Series_DSP48E1.pdf 要了解DSP48E1的数量，您可以 ...
回答了问题 2020-7-19 09:01

如何将IP从Spartan3迁移到Artix 7？

wufengju

嗨，接口改变背后的具体原因是坚持行业标准并拥有所有核心类似的接口。有关接口更改，请参阅PG149或DS795中的“从版本5.0到版本6 / 7.x的端口更改.x”。此外，在“XCO参数更改”表中可以看到核心设置的变化很少 ...
回答了问题 2020-7-19 08:42

如何将IP从Spartan3迁移到Artix 7？

wufengju

嗨，在Spartan-3版本中生成的IP可能是5.0，没有AXI接口，但Vivado verison只有A***的行为几乎相同，但界面会有所不同。产品指南将为您提供迁移详细信息，您可以根据这些详细信息确保界面相同，但核心没有本机选项 ...
回答了问题 2020-7-19 08:33

如何将IP从Spartan3迁移到Artix 7？

wufengju

嗨，接口改变背后的具体原因是坚持行业标准并拥有所有核心类似的接口。有关接口更改，请参阅PG149或DS795中的“从版本5.0到版本6 / 7.x的端口更改.x”。此外，在“XCO参数更改”表中可以看到核心设置的变化很少 ...
回答了问题 2020-7-19 07:06

分布式RAM和Block RAM之间究竟有什么区别？

zong2443

嗨，有关Ditributed与Block RAM的差异，请参阅以下链接。 http://forums.xilinx.com/t5/Embedded-Development-Tools/difference-between-distributed-and-block-ram/td-p/81867 有关资源及其功能的详细信息，请浏览 ...
回答了问题 2020-7-18 06:58

是否可以使用HDMI在3.3V电源组上使用Kintex-7驱动液晶显示器

411easddzf

嗨，我认为TMDS33是可用的，请参考UG471 IO标准部分了解更多信息 http://www.xilinx.com/support/documentation/user_guides/ug471_7Series_SelectIO.pdf 希望这可以帮助 Reagrds， Vanitha。 -------------------- ...
回答了问题 2020-7-18 06:41

是否可以使用HDMI在3.3V电源组上使用Kintex-7驱动液晶显示器

411easddzf

嗨，我认为TMDS33是可用的，请参考UG471 IO标准部分了解更多信息 http://www.xilinx.com/support/documentation/user_guides/ug471_7Series_SelectIO.pdf 希望这可以帮助 Reagrds， Vanitha。 -------------------- ...
回答了问题 2020-7-16 10:12

K7 FPGA来设计电路板,连接引脚时应注意什么？

sunrongsheng

嗨，如果为FPGA和存储器设备生成MIG，它将在user_design / par文件夹中为您提供默认的引脚分配。如果您还没有完成电路板布局，您可以选择deafult作为引脚排列或将其用作参考，根据您的要求进行更改，并通过验证ucf ...
回答了问题 2020-7-14 16:59

请问如何在FPGA中实现DDR3 SDRAM功能？

JSDGS

嗨，小内存密度似乎很好。在这种情况下，您的IO应该以1600Mbps运行，并且您需要像DDR3芯片那样进行所有预取，地址解码。请通过以下相关主题获取更多输入。 http://forums.xilinx.com/t5/New-Users-Forum/DDR3-DQ- ...
回答了问题 2020-7-14 09:58

使用ise14.6 forVirtex7xc7vx690t-ffg1761设计它与消息映射失败的原因？

tussi_pre1

嗨，如错误消息中所述，SmartGuide要求指南文件使用与当前目标设备相同的Vendor，Family，Device和Package。在启用了SmartGuide的项目中更改目标设备时，可能会发生此错误。指南文件是从先前在上一个目标设备上的 ...
回答了问题 2020-6-18 10:49

DDR2内存与Microblaze如何连接？

小点zze

@kishanvasu ISE 12.4太旧了，可能已知问题和修复。其中一个以及与您的错误匹配的内容如下 http://www.xilinx.com/support/answers/52558.html 所以请将ISE升级到14.7，看看它是怎么回事还尝试使用集成的MIG及其uc ...
回答了问题 2020-6-17 15:50

LVDS发送器IP可用于Virtex6和Virtex7 FPGA吗

tech_lou

嗨，它看起来Xapp928的概念接近你所需要的，希望它能为你提供7系列设备等效资源的良好开端。 http://www.google.co.in/url?url=http://www.openhw.org/down/%3Faction%3Ddown%26url%3DL2Rvd24vP2FjdGlvbj1zaG93Jmlk ...
回答了问题 2020-6-17 11:46

在Virtex-5 FPGA中如何使用BRAM代替SRAM

testd001zz

嗨，我不认为任何困难，你可以使用BRAM核心来存储ADC样本。请访问下面的网页，然后阅读文档，以便撰写和阅读详细信息。 http://www.xilinx.com/products/intellectual-property/Block_Memory_Generator.htm 问候， ...
回答了问题 2020-6-16 14:44

似乎没有检测到“CLOCK_DEDICATED_ROUTE = FALSE”约束是怎么回事

frzzing

嗨，这种情况几乎没有可能发生，请参考以下链接 http://www.xilinx.com/support/answers/34346.htm 希望这可以帮助。问候， Vanitha。 -------------------------------------------------- -------------------- ...
回答了问题 2020-6-16 14:31

似乎没有检测到“CLOCK_DEDICATED_ROUTE = FALSE”约束是怎么回事

frzzing

嗨，这种情况几乎没有可能发生，请参考以下链接 http://www.xilinx.com/support/answers/34346.htm 希望这可以帮助。问候， Vanitha。 -------------------------------------------------- -------------------- ...

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