如何设置差分时钟约束？

您需要做的就是在输入的200MHz时钟上设置5 ns周期限制。
此周期约束将自动传播到DCM，MMCM，PLL等的输出。如果设置时钟向导以生成150MHz时钟，则工具将时钟输出限制为150MHz。
bailin7134写道：
感谢您的回复。
可能是我没有清楚地提出我的问题。
在我的设计中，我使用这个200MHz差分时钟并在核心发生器中使用Clocking Wizard 3.3来将其调节为我的系统时钟。
如果我想为此系统时钟设置约束以满足时序要求（例如150MHz），我该怎么办？
谢谢。
干杯，吉姆
在原帖中查看解决方案

你想要约束什么时钟？
200MHz差分输入时钟？
66MHz单端输入时钟？
内部生成的时钟之一？
哪一个？
- 鲍勃埃尔金德
签名：新手的自述文件在这里：http：//forums.xilinx.com/t5/New-Users-Forum/README-first-Help-for-new-users/td-p/219369总结：1。
阅读手册或用户指南。
你读过手册了吗？
你能找到手册吗？2。
搜索论坛（并搜索网页）以寻找类似的主题。
不要在多个论坛上发布相同的问题。
不要在别人的主题上发布新主题或问题，开始新的主题！5。
学生：复制代码与学习设计不同.6“它不起作用”不是一个可以回答的问题。
提供有用的详细信息（请与网页，数据表链接）.7。
您的代码中的评论不需要支付额外费用。
我没有支付论坛帖子的费用。
如果我写一篇好文章，那么我一无所获。

200 MHz差分时钟

在ISE Navigator中，突出显示项目“层次结构”窗格中的.UCF文件。
然后选择“工具”>“约束编辑器”。
这将打开一个用于选择时钟和添加约束的GUI。
- 鲍勃埃尔金德
签名：新手的自述文件在这里：http：//forums.xilinx.com/t5/New-Users-Forum/README-first-Help-for-new-users/td-p/219369总结：1。
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