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Verilog HDL程序设计教程

1652711011.026500

2009-11-25 09:31:48 12876

0 Verilog HDL程序设计教程例子： 4位全加器 module adder4(cout,sum,ina,inb,cin); output[3:0] sum; output cout; input[3:0] ina,inb; input cin; assign {cout,sum}=ina+inb+cin; endmodule 游客，如果您要查看本帖隐藏内容请回复 0
2009-11-25 09:31:48　　评论淘帖0 举报相关推荐 • Verilog HDL程序设计案例 18 • Verilog HDL 程序设计教程 6 • Verilog HDL程序设计教程 15 • 《Verilog HDL程序设计与应用》 116 • Verilog HDL程序设计教程 37 • Verilog HDL程序设计与实践 21 • Verilog HDL程序设计与实践 27 • Verilog HDL程序设计例程 176 • Verilog例程 Verilog HDL程序设计教程 2 • 《Verilog HDL 程序设计教程》 4452 82 个讨论

0 XUXIEXIE !!!!!!!!!!!!!!!!!!!!

2009-11-27 21:54:38 评论举报 1^# suwx

0 好

2009-12-4 21:16:02 评论举报 2^# h1654155730.3336

0 好

2009-12-6 21:20:01 评论举报 3^# lxm1252

0 级卡

2009-12-7 10:09:36 评论举报 4^# dreamer_hdz

0 好东西

2009-12-17 09:26:37 评论举报 5^# w2034107

0 GOOD

2009-12-17 09:35:52 评论举报 6^# A2034107

0 好

2009-12-18 11:20:19 评论举报 7^# zhangweiccz

0 ?

2010-1-22 10:23:36 评论举报 8^# h1654155729.4020

0 thanks !

2010-1-24 19:59:46 评论举报 9^# liyunhu

0 感兴趣

2010-3-20 22:09:37 评论举报 10^# sintech

0 好大学

2010-4-2 11:16:22 评论举报 11^# xz1200901902

0 饿

2010-4-2 15:38:11 评论举报 12^# 砂砾

0 谢谢分享

2010-4-3 16:07:21 评论举报 13^# lihao8567

0 学习

2010-4-23 21:54:34 评论举报 14^# 兰

0 先顶一个再说！！

2010-4-27 11:58:07 评论举报 15^# cduestc

0 非常好

2010-5-15 09:10:24 评论举报 16^# wy922003

0 顶LZ~~~

2010-5-16 13:38:54 评论举报 17^# lockck87

0 谁的教材呀看下

2010-6-15 18:07:03 评论举报 18^# digital

0 瞧瞧

2010-6-18 17:09:00 评论举报 19^# xutiant001

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