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我已经解决了,书上有的单词印错了,我已经改好了!
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library ieee;
use ieee.std_logic_1164.all; use ieee.std_logic_unsigned.all; entity VHDL1 is generic(n:integer:=4); port( A,B:in std_logic_vector(n-1 downto 0); cin:std_logic; Y:out std_logic_vector(n-1 downto 0); cout:out std_logic ); end entity VHDL1; architecture ARCH of VHDL1 is signal TMP:std_logic_vector(n downto 0); begin TMP <= '0' & (A+B+cin); Y <= TMP(n-1 downto 0); cout <= TMP(n); end architecture ARCH; |
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这个编译通过了。
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