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李工解答PCB设计 高手问答第6期 李工说: ———————————————————————————————— 本期高手问答时间:8月4日-8月11日———————————————————————————————— 李工简介: 你在为PCB Layout中高速信号线烦恼吗? 你在为PCB Layout中覆铜操作而不知所措? ······ 或许,你可以动动你的五指,按下enter键,跟帖提问,并@lotusp我们的李工哟,maybe热心的李工就能给你把问题解决or指引一个方向哟! 同往常一样,我们的高手问答,还是回帖提问,记得同时@lotusp (李工)。 ***************问答精华************** ———————————————————————————————————————— 社区高手招募 不限专业领域、不限技术方向,只要你是一个有活力并乐于分享的开发者,只要你愿意把自己的经验收获分享给大家,帮助众多从业者共同学习、共同进步,我们就欢迎你来做客社区高手问答。 联系方式:pengjiali@elecfans.com。快来联系小编吧!———————————————————————————————————————— 往期回顾: 本帖被以下淘专辑推荐:
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你用的是哪个软件?cadence ? pads ? ad ? |
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可以镀锡,加上助焊,漏锡上去,用铜排看你的布局 了~ |
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图片 没看到,你不要用汉字,注释,说明用英文~ |
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这让我怎么回答你呢~~~一个输出时钟~~去看看差分信号定义~~普通信号也算差分,参考是地~ |
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●多层板具有正确的多层设置(stackup assignment)和阻抗控制。 ●将频率走线(clock trace)绕到回传路径接地平面(多层PCB)、接地网格(ground grid)的附近,单侧和双侧板可以使用接地走线,或安全走线(guard trace)。 ●将组件的塑料封装内部所产生的磁通线,捕捉到0V的参考系统中,以降低组件的辐射量。 ●警慎选择逻辑组件,尽量减少组件和走线所辐射的射频频谱分布量。可以使用讯号缘变化率(edge rate)比较慢的装置。 ●藉由降低射频驱动电压(来自频率产生电路,例如:TTL/CMOS),来降低走在线的射频电流。 ●降低接地噪声电压,此电压存在于供电和接地平面结构中。 ●当必须推动最大电容负载,而所有装置的脚位同时切换时,组件的去耦合(decoupling)电路必须充足。 ●必须将频率和讯号走线做妥善的终结,以避免发生阻尼振荡(ringing)、电压过高(overshoot)、电压过低(undershoot)。 ●在选定的网络上,使用数据线路滤波器和共模扼流圈(common-mode choke)。 ●当有提供外部I/O缆线时,必须正确地使用旁路(非去耦合)电容。 ●为会辐射大量的共模式射频能量(由组件内部产生)之组件,提供一个接地的散热器(heatsink)。 检视上面所列的项目,可以知道,磁通线只是「在PCB内会产生EMI」的部份原因而已。其它原因还有: ●在电路和I/O缆线之间,有共模和差模(differential mode)电流存在。 ●接地回路会产生一个磁场结构。 ●组件会辐射。 ●阻抗不匹配。 去买本电磁兼容的书好好学习一下,一两句说不清楚, |
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柔性PCB的介电常数 ! |
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请问在PCB中怎么区分信号线和电源线? 难道说所有IC的管脚除了VCC和GND都属于信号线么???为什么信号线可以非常的细,可以达到0.2mm,这么细的线不会被烧掉么??难道从电源通到IC中的电流非常非常的小么??为什么地线比电源线要粗些呢?在我的理解中电源线和地线应该是一样粗的呀。然后,IC的GND和VCC管脚的线宽也要和地线和电源线一样粗么??求解不胜感激
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