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module comparator(A,B,R);
input [3:0] A; input [3:0] B; output [1:0]R; reg D; always @(B)begin if(A>B)begin D<=2'b01; end else if(A end else begin D<=2'b11 end end assign R=D; endmodule // 大致写了下，不知道对不对。 有ERROR的话，请见谅 |
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