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从输出特性看, 可以看成是带上拉的 OD 输出.
从功能看, End of conversion. EOC goes from a high to a low logic level after the falling edge of the last I/O CLOCK and remains low until the conversion is complete and data are ready for transfer. 你并在一起, 那么两个 EOC 都输出高, 才有 EOC 有效信号 |
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如果是开漏输出会在数据手册中描述，因此这个引脚我建议不用上拉。
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是推挽输出，不是开漏输出。
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在使用多片TLV2543进行AD采集时，EOC（End of Conversion）管脚可以共用。TLV2543的EOC管脚是一个推挽输出，这意味着它可以输出高电平或低电平。在多片TLV2543共用EOC管脚的情况下，每个芯片的EOC管脚都需要外部10K上拉，以确保在没有输出时，EOC管脚保持高电平。
根据您的描述，您已经将3片TLV2543的EOC管脚连接在一起，并为每个芯片的EOC管脚提供了外部10K上拉。这种设计是可行的，不会损坏管脚或芯片。以下是一些建议和注意事项： 1. 确保所有TLV2543的供电和地线连接正确，以避免潜在的电源问题。 2. 在多片TLV2543共用EOC管脚的情况下，确保SPI接口的时钟线（SCLK）、数据线（SDI/SDO）和片选线（CS）也正确连接。 3. 由于EOC管脚是推挽输出，当多个芯片的EOC管脚共用时，可能会出现电平冲突。为了避免这种情况，可以在EOC管脚上添加一个小的上拉电阻（例如1KΩ），以确保在没有输出时，EOC管脚保持高电平。 4. 在设计时，确保所有TLV2543的采样速率和分辨率设置相同，以确保数据的一致性。 总之，您的设计是可行的，只要确保供电、地线和SPI接口连接正确，以及在EOC管脚上添加适当的上拉电阻，就可以避免损坏管脚或芯片。 |
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