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输入谐波排除是在输入端加了一个滤波器30Mhz带通滤波模块。 随着输入频率变化，总存在输入信号的2，3次谐波，2次比基频低20dB左右。
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根据您的描述，您在使用ADC12D1000进行数据采集时，发现2、3次谐波幅度很大，导致信噪比（SNR）和无杂散动态范围（SFDR）较差。您已经排除了电源、时钟和输入信号的原因。以下是一些建议，可能有助于解决问题：
1. 检查ADC12D1000的配置参数：确保ADC的配置参数正确设置，如采样率、量化位数等。错误的配置可能导致谐波失真。 2. 检查FPGA的数字滤波器：在FPGA中实现的数字滤波器可能对谐波产生影响。检查滤波器的设计和实现，确保其能够有效地抑制谐波。 3. 检查FPGA的时钟管理：确保FPGA的时钟信号稳定且无抖动。时钟抖动可能导致谐波失真。 4. 检查FPGA的信号处理链路：检查FPGA中的信号处理链路，如模数转换、滤波、增益调整等，确保各环节的实现正确且无误。 5. 检查FPGA的电源和地：确保FPGA的电源和地连接良好，无短路或断路现象。不良的电源和地连接可能导致谐波失真。 6. 检查FPGA的布局和布线：检查FPGA的布局和布线，确保信号路径尽可能短且无环路。不良的布局和布线可能导致谐波失真。 7. 考虑使用外部谐波抑制技术：如果FPGA内部的谐波抑制效果不佳，可以考虑使用外部的谐波抑制技术，如使用低通滤波器、陷波滤波器等。 8. 与TI技术支持联系：如果以上建议都无法解决问题，建议您联系TI的技术支持，他们可能会提供更具体的解决方案。 希望以上建议对您有所帮助。祝您解决问题顺利！ |
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